參數(shù)資料
型號: AD5722RBREZ-REEL7
廠商: Analog Devices Inc
文件頁數(shù): 17/32頁
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描述: IC DAC DUAL 12BIT 1LSB 24TSSOP
產品培訓模塊: Data Converter Fundamentals
DAC Architectures
設計資源: Software Configurable 12-Bit Dual-Channel Unipolar/Bipolar Voltage Output Using AD5722R (CN0091)
標準包裝: 1,000
設置時間: 10µs
位數(shù): 12
數(shù)據接口: 串行
轉換器數(shù)目: 2
電壓電源: 模擬和數(shù)字,雙 ±
功率耗散(最大): 190mW
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 24-TSSOP(0.173",4.40mm)裸露焊盤
供應商設備封裝: 24-TSSOP 裸露焊盤
包裝: 帶卷 (TR)
輸出數(shù)目和類型: 2 電壓,單極;2 電壓,雙極
采樣率(每秒): 1.07M
AD5722R/AD5732R/AD5752R
Rev. D | Page 24 of 32
Ideal Output Voltage to Input Code Relationship—AD5732R
Table 11. Bipolar Output, Offset Binary Coding
Digital Input
Analog Output
MSB
LSB
±5 V Output Range
±10 V Output Range
±10.8 V Output Range
11
1111
+2 × REFIN × (8191/8192)
+4 × REFIN × (8191/8192)
+4.32 × REFIN × (8191/8192)
11
1111
1110
+2 × REFIN × (8190/8192)
+4 × REFIN × (8190/8192)
+4.32 × REFIN × (8190/8192)
10
0000
0001
+2 × REFIN × (1/8192)
+4 × REFIN × (1/8192)
10
0000
0 V
01
1111
2 × REFIN × (1/8192)
4 × REFIN × (1/8192)
4.32 × REFIN × (1/8192)
00
0000
0001
2 × REFIN × (8190/8192)
4 × REFIN × (8190/8192)
4.32 × REFIN × (8190/8192)
00
0000
2 × REFIN × (8191/8191)
4 × REFIN × (8191/8192)
4.32 × REFIN × (8191/8192)
Table 12. Bipolar Output, Twos Complement Coding
Digital Input
Analog Output
MSB
LSB
±5 V Output Range
±10 V Output Range
±10.8 V Output Range
01
1111
+2 × REFIN × (8191/8192)
+4 × REFIN × (8191/8192)
+4.32 × REFIN × (8191/8192)
01
1111
1110
+2 × REFIN × (8190/8192)
+4 × REFIN × (8190/8192)
+4.32 × REFIN × (8190/8192)
00
0000
0001
+2 × REFIN × (1/8192)
+4 × REFIN × (1/8192)
00
0000
0 V
11
1111
2 × REFIN × (1/8192)
4 × REFIN × (1/8192)
4.32 × REFIN × (1/8192)
10
0000
0001
2 × REFIN × (8190/8192)
4 × REFIN × (8190/8192)
4.32 × REFIN × (8190/8192)
10
0000
2 × REFIN × (8191/8192)
4 × REFIN × (8191/8192)
4.32 × REFIN × (8191/8192)
Table 13. Unipolar Output, Straight Binary Coding
Digital Input
Analog Output
MSB
LSB
+5 V Output Range
+10 V Output Range
+10.8 V Output Range
11
1111
+2 × REFIN × (16,383/16,384)
+4 × REFIN × (16,383/16,384)
+4.32 × REFIN × (16,383/16,384)
11
1111
1110
+2 × REFIN × (16,382/16,384)
+4 × REFIN × (16,382/16,384)
+4.32 × REFIN × (16,382/16,384)
10
0000
0001
+2 × REFIN × (8193/16,384)
+4 × REFIN × (8193/16,384)
+4.32 × REFIN × (8193/16,384)
10
0000
+2 × REFIN × (8192/16,384)
+4 × REFIN × (8192/16,384)
+4.32 × REFIN × (8192/16,384)
01
1111
+2 × REFIN × (8191/16,384)
+4 × REFIN × (8191/16,384)
+4.32 × REFIN × (8191/16,384)
00
0000
0001
+2 × REFIN × (1/16,384)
+4 × REFIN × (1/16,384)
+4.32 × REFIN × (1/16,384)
00
0000
0 V
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