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參數(shù)資料
型號： AD7400AYNSZ
廠商： Analog Devices Inc
文件頁數(shù)： 15/20頁
文件大?。?/td> 0K
描述： IC MODULATOR SIGMADELTA 8-SMD
產(chǎn)品變化通告： AD7400AYNSZ Discontinuation 23/Mar/2012
標(biāo)準(zhǔn)包裝： 50
類型： 調(diào)制器
分辨率（位）： 16 b
采樣率（每秒）： 10M
數(shù)據(jù)接口： 串行
電壓電源： 單電源
電源電壓： 4.5 V ~ 5.5 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 8-SMD，鷗翼型
供應(yīng)商設(shè)備封裝： 8-DIP 鷗翼型
包裝： 管件
產(chǎn)品目錄頁面： 798 (CN2011-ZH PDF)
AD7400A
Data Sheet
Rev. D | Page 4 of 20
TIMING SPECIFICATIONS
VDD1 = 4.5 V to 5.5 V, VDD2 = 3 V to 5.5 V, TA = 40°C to +125°C, except where specified.1
Table 2.
Parameter
Limit at tMIN, tMAX
Unit
Description
fMCLKOUT2
10
MHz typ
Master clock output frequency
9/11
MHz min/MHz max
Master clock output frequency
40
ns max
Data access time after MCLK rising edge
10
ns min
Data hold time after MCLK rising edge
t3
0.4 × tMCLKOUT
ns min
Master clock low time
t4
0.4 × tMCLKOUT
ns min
Master clock high time
1
Sample tested during initial release to ensure compliance.
2
Mark space ratio for clock output is 40/60 to 60/40.
3
Measured with the load circuit shown in Figure 2 and defined as the time required for the output to cross 0.8 V or 2.0 V.
200A
IOL
200A
IOH
+1.6V
TO OUTPUT
PIN
CL
25pF
07077-
002
Figure 2. Load Circuit for Digital Output Timing Specifications
MCLKOUT
MDAT
t1
t2
t4
t3
07077-
003
Figure 3. Data Timing
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