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參數(shù)資料
| 型號： | AD9783BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 32/32頁 |
| 文件大小： | 0K |
| 描述： | IC DAC 16BT 500MSPS LVDS 72LFCSP |
| 產(chǎn)品培訓(xùn)模塊： | Data Converter Fundamentals DAC Architectures |
| 標準包裝： | 1 |
| 位數(shù)： | 16 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 2 |
| 電壓電源： | 模擬和數(shù)字 |
| 功率耗散（最大）： | 315mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 72-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 72-LFCSP-VQ（10x10） |
| 包裝： | 托盤 |
| 輸出數(shù)目和類型： | 4 電流，單極；4 電流，雙極 |
| 采樣率（每秒）： | 600M |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁當(dāng)前第32頁
Data Sheet
AD9780/AD9781/AD9783
Rev. B | Page 9 of 32
06936-
004
1
2
3
4
5
6
7
8
9
10
11
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13
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15
16
CVDD18
CVSS
CLKP
CLKN
CVSS
CVDD18
DVSS
DVDD18
D15P
D15N
D14P
D14N
D13P
D13N
D12P
D12N
17
D11P
18
D11N
19
20
21
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23
24
25
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27
28
29
30
31
32
33
34
D10
P
D10N
D9
P
D9N
D8
P
D8N
DCO
P
DCO
N
DV
DD33
D
VSS
DCI
P
DCI
N
D7
P
D7N
D6
P
D6N
35
D5
P
36
D5N
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
FS ADJ
RESET
CSB
SCLK
SDIO
SDO
DVSS
DVDD18
D0N
D0P
D1N
D1P
D2N
D2P
D3N
D3P
D4N
D4P
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
A
V
DD33
A
V
DD33
A
VSS
IOU
T1
P
IOU
T1
N
A
VSS
AUX
1
P
AUX
1N
A
VSS
AUX
2N
AUX
2
P
A
VSS
IOU
T2
N
IOU
T2
P
A
VSS
A
V
DD33
A
V
DD33
R
E
FIO
PIN 1
INDICATOR
AD9783
(TOP VIEW)
NOTES
1. EXPOSED PAD MUST BE
SOLDERED TO PCB AND
CONNECTED TO AVSS.
Figure 4. AD9783 Pin Configuration
Table 8. AD9783 Pin Function Descriptions
Pin No.
Mnemonic
Description
1, 6
CVDD18
Clock Supply Voltage (1.8 V).
2, 5
CVSS
Clock Supply Return.
3, 4
CLKP, CLKN
Differential DAC Sampling Clock Input.
7, 28, 48
DVSS
Digital Common.
8, 47
DVDD18
Digital Supply Voltage (1.8 V).
9 to 24, 31 to 46
D15P, D15N to D0P, D0N
LVDS Data Inputs. D15 is the MSB, D0 is the LSB.
25, 26
DCOP, DCON
Differential Data Clock Output. Clock at the DAC sample rate.
27
DVDD33
Digital Input and Output Pad Ring Supply Voltage (3.3 V).
29, 30
DCIP, DCIN
Differential Data Clock Input Clock aligned with input data.
49
SDO
Serial Port Data Output.
50
SDIO
Serial Port Data Input (4-Wire Mode) or Bidirectional Serial Data Line (3-Wire Mode).
51
SCLK
Serial Port Clock Input.
52
CSB
Serial Port Chip Select (Active Low).
53
RESET
Chip Reset (Active High).
54
FS ADJ
Full-Scale Current Output Adjust.
55
REFIO
Analog Reference Input/Output (1.2 V Nominal).
56, 57, 71, 72
AVDD33
Analog Supply Voltage (3.3 V).
58, 61, 64, 67, 70
AVSS
Analog Common.
59
IOUT2P
DAC Current Output. Full-scale current is sourced when all data bits are 1s.
60
IOUT2N
Complementary DAC Current Output. Full-scale current is sourced when all data bits are 0s.
62, 63
AUX2P, AUX2N
Differential Auxiliary DAC Current Output (Channel 2).
65, 66
AUX1N, AUX1P
Differential Auxiliary DAC Current Output (Channel 1).
68
IOUT1N
Complementary DAC Current Output. Full-scale current is sourced when all data bits are 0s.
69
IOUT1P
DAC Current Output. Full-scale current is sourced when all data bits are 1s.
Heat Sink Pad
N/A
The heat sink pad on the bottom of the package should be soldered to the PCB plane that
carries AVSS.
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PDF描述 |
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參數(shù)描述 |
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