參數(shù)資料
型號(hào)： ADSP-21060KB-160
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 17/64頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 32BIT 225BGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類(lèi)型： 浮點(diǎn)
接口： 主機(jī)接口，連接端口，串行端口
時(shí)鐘速率： 40MHz
非易失內(nèi)存： 外部
芯片上RAM： 512kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： 0°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 225-BBGA
供應(yīng)商設(shè)備封裝： 225-PBGA
包裝： 托盤(pán)
Rev. F
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March 2008
ADSP-21060/ADSP-21060L/ADSP-21062/ADSP-21062L/ADSP-21060C/ADSP-21060LC
Flags
Table 13. Flags
5 V and 3.3 V
Unit
Parameter
Min
Max
Timing Requirements
tSFI
FLAG3–0 IN Setup Before CLKIN High1
8 + 5DT/16
ns
tHFI
FLAG3–0 IN Hold After CLKIN High1
0 – 5DT/16
ns
tDWRFI
FLAG3–0 IN Delay After RD/WR Low1
5 + 7DT/16
ns
tHFIWR
FLAG3–0 IN Hold After RD/WR Deasserted1
0ns
Switching Characteristics
tDFO
FLAG3–0 OUT Delay After CLKIN High
16
ns
tHFO
FLAG3–0 OUT Hold After CLKIN High
4
ns
tDFOE
CLKIN High to FLAG3–0 OUT Enable
3
ns
tDFOD
CLKIN High to FLAG3–0 OUT Disable
14
ns
1 Flag inputs meeting these setup and hold times for instruction cycle N will affect conditional instructions in instruction cycle N+2.
Figure 13. Flags
CLKIN
FLAG3–0 OUT
FLAG OUTPUT
CLKIN
FLAG INPUT
tDFO
tHFO
tDFO
tDFOD
tDFOE
tSFI
tHFI
tHFIWR
tDWRFI
RD/WR
FLAG3–0 IN
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PDF描述
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ADSP-21060KS-160 IC DSP CONTROLLER 32BIT 240MQFP
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