Figure 34. Typical Drive Currents (V
參數(shù)資料
型號： ADSP-21061KS-160
廠商： Analog Devices Inc
文件頁數(shù)： 40/52頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 1MBIT 240MQFP
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點
接口： 同步串行端口（SSP）
時鐘速率： 40MHz
非易失內(nèi)存： 外部
芯片上RAM： 128kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 240-BFQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 240-MQFP-EP（32x32）
包裝： 托盤
Rev. D | Page 45 of 52 | May 2013
Input/Output Characteristics (3.3 V)
Figure 34. Typical Drive Currents (VDD = 3.3 V)
Figure 35. Typical Output Rise Time (10% to 90% VDD) vs. Load Capacitance
(VDD = 3.3 V)
SOURCE VOLTAGE (V)
120
-
20
-
80
0
3.5
S
O
U
R
C
E
C
U
R
E
N
T
(m
A
)
0.5
1.0
1.5
2.0
2.5
3.0
100
0
-
40
-
60
20
80
40
-
100
-
120
3.0V, +85°C
3.3V, +25°C
3.6V, -40°C
3.3V, +25°C
3.0V, +85°C
VOH
VOL
LOAD CAPACITANCE (pF)
0
2
0
20
40
60
80100
120
Y = 0.0796x + 1.17
Y = 0.0467x + 0.55
RISETIME
FALL TIME
140
160
180200
4
6
8
10
12
14
16
18
R
IS
E
A
N
D
F
A
L
T
IM
E
S
(n
s
)
(1
0
%
to
9
0
%
)
Figure 36. Typical Output Rise Time (0.8 V to 2.0 V) vs. Load Capacitance
(VDD = 3.3 V)
Figure 37. Typical Output Delay or Hold vs. Load Capacitance (at Maximum
Case Temperature) (VDD = 3.3 V)
LOAD CAPACITANCE (pF)
0
20
40
60
80
100
120
Y= 0.0391x + 0.36
Y= 0.0305x + 0.24
RISETIME
FALL TIME
140
160
180200
R
IS
E
A
N
D
F
A
L
T
IM
E
S
(n
s
)
(0
.8
V
to
2
.0
V
)
1
2
3
4
5
6
7
8
9
LOAD CAPACITANCE (pF)
O
U
T
P
U
T
D
E
L
A
Y
O
R
H
O
L
D
(n
s
)
5
-
1
25
200
50
75
100
125
150
175
4
3
2
1
NOMINAL
Y= 0.0329x - 1.65
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