參數(shù)資料
型號(hào): ADSP-21062KSZ-133
廠商: Analog Devices Inc
文件頁(yè)數(shù): 41/64頁(yè)
文件大?。?/td> 0K
描述: IC DSP CONTROLLER 32BIT 240MQFP
產(chǎn)品培訓(xùn)模塊: SHARC Processor Overview
標(biāo)準(zhǔn)包裝: 1
系列: SHARC®
類(lèi)型: 浮點(diǎn)
接口: 主機(jī)接口,連接端口,串行端口
時(shí)鐘速率: 33MHz
非易失內(nèi)存: 外部
芯片上RAM: 256kB
電壓 - 輸入/輸出: 5.00V
電壓 - 核心: 5.00V
工作溫度: 0°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 240-BFQFP 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝: 240-MQFP-EP(32x32)
包裝: 托盤(pán)
Rev. F
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March 2008
ADSP-21060/ADSP-21060L/ADSP-21062/ADSP-21062L/ADSP-21060C/ADSP-21060LC
JTAG Test Access Port and Emulation
For JTAG Test Access Port and Emulation, see Table 36 and
Table 36. JTAG Test Access Port and Emulation
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
tCK
ns
tSTAP
TDI, TMS Setup Before TCK High
5
ns
tHTAP
TDI, TMS Hold After TCK High
6
ns
tSSYS
System Inputs Setup Before TCK Low1
7ns
tHSYS
System Inputs Hold After TCK Low1, 2
18
ns
tTRSTW
TRST Pulse Width
4 tCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
13
ns
tDSYS
System Outputs Delay After TCK Low3
18.5
ns
1 System Inputs = DATA63–0, ADDR31–0, RD, WR, ACK, SBTS, HBR, HBG, CS, DMAR1, DMAR2, BR6–1, ID2–0, RPBA, IRQ2–0, FLAG3–0, PA, BRST, DR0, DR1, TCLK0,
TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT7–0, LxCLK, LxACK, EBOOT, LBOOT, BMS, CLKIN, RESET.
2 For ADSP-21060L/ADSP-21060LC/ADSP-21062L, specification is 18.5 ns min.
3 System Outputs = DATA63–0, ADDR31–0, MS3–0, RD, WR, ACK, PAGE, CLKOUT, HBG, REDY, DMAG1, DMAG2, BR6–1, PA, BRST, CIF, FLAG3–0, TIMEXP, DT0,
DT1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT7–0, LxCLK, LxACK, BMS.
Figure 27. JTAG Test Access Port and Emulation
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tSTAP
tTCK
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
相關(guān)PDF資料
PDF描述
TAJC684K050SNJ CAP TANT 0.68UF 50V 10% 2312
EEM10DRKF CONN EDGECARD 20POS DIP .156 SLD
171-025-202L021 CONN DB25 FEMALE SOLDER CUP TIN
EBM24DCSH CONN EDGECARD 48POS DIP .156 SLD
ADSP-2171BSZ-133 IC DSP CONTROLLER 16BIT 128PQFP
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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