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參數(shù)資料
| 型號： | ADUC7021BCP62 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Precision Analog Microcontroller 12-bit Analog I/O, ARM7TDMI MCU |
| 中文描述： | 32-BIT, FLASH, 45.5 MHz, MICROCONTROLLER, QCC40 |
| 封裝： | 6 X 6 MM, MO-220VJJD-2, LFCSP-40 |
| 文件頁數(shù)： | 41/80頁 |
| 文件大?。?/td> | 840K |
| 代理商： | ADUC7021BCP62 |
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Preliminary Technical Data
ADuC702x Series
Rev. PrB | Page 41 of 80
Table 23: PLLCON MMR bit designations
Bit
7-3
2
Name
SCLKS
Description
Reserved
Slow clock selection for watchdog timer:
Set
by the user to use the internal 32kHz for the timer. This bit must be set to use watchdog timer if there
is no external crystal
Cleared
by user to use the external 32kHz crystal
Clocking modes
00
Reserved
01
PLL + 32kHz oscillator – default configuration
10
Reserved
11
XCLK pin
1-0
MDCLK
Table 24: POWCON MMR bit designations
Bit
7
6-4
Name
PC
Description
Reserved
Operating modes:
000
011
Others
Fast interrupt response bit
Set
by user to enable the fast interrupt response. If an interrupt occurs when FINT is set, the CPU will run
at the fastest clock frequency in the interrupt service routine. After completing the ISR, execution resumes
at the clock speed set by the CD bits
Cleared
by user to disable the fast interrupt response
CPU clock divider bits
000
45.088 MHz
001
22.544 MHz
010
11.272 MHz
011
5.636 MHz
100
2.818 MHz
101
1.409 MHz
110
704.5 kHz
111
352.2 kHz
Normal mode
Power down mode enable. XIRQ0, XIRQ1, timer2 and timer3 can wake-up the ADuC702x.
Reserved
3
FINT
2-0
CD
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