參數(shù)資料
型號(hào): ADUC7124BCPZ126
廠商: Analog Devices Inc
文件頁數(shù): 62/108頁
文件大?。?/td> 0K
描述: IC DAS MCU ARM7 ADC/DDS 64LQFP
產(chǎn)品培訓(xùn)模塊: Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
標(biāo)準(zhǔn)包裝: 1
系列: MicroConverter® ADuC7xxx
核心處理器: ARM7
芯體尺寸: 16/32-位
速度: 41.78MHz
連通性: EBI/EMI,I²C,SPI,UART/USART
外圍設(shè)備: POR,PWM,WDT
輸入/輸出數(shù): 30
程序存儲(chǔ)器容量: 126KB(63K x 16)
程序存儲(chǔ)器類型: 閃存
RAM 容量: 32K x 8
電壓 - 電源 (Vcc/Vdd): 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 10x12b; D/A 2x12b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 125°C
封裝/外殼: 64-LFQFN 裸露焊盤,CSP
包裝: 托盤
Data Sheet
ADuC7124/ADuC7126
Rev. C | Page 57 of 108
Table 77. POWCON1 MMR Bit Descriptions1
Bit
Value
Name
Description
[15:12]
Reserved.
11
1
PWMPO
Clearing this bit powers
down the PWM. Always
clear to 00.
[10:9]
00
PWMCLKDIV
8
SPIPO
Clearing this bit powers
down the SPI.
[7:6]
SPICLKDIV
SPI block driving clock
divider bits.
00
41.78 MHz.
01
20.89 MHz.
10
10.44 MHz.
11
5.22 MHz.
5
I2C1PO
Clearing this bit powers
down I2C1.
[4:3]
I2C1CLKDIV
I2C0 block driving clock
divider bits.
00
41.78 MHz.
01
10.44 MHz.
10
5.22 MHz.
11
1.31 MHz.
2
I2C0PO
Clearing this bit powers
down I2C0.
[1:0]
I2C0CLKDIV
I2C1 block driving clock
divider bits.
00
41.78 MHz.
01
10.44 MHz.
10
5.22 MHz.
11
1.31 MHz.
The POWCON1 write sequence is as follows:
1.
Write Code 0x76 to Register POWKEY3.
2.
Write user value to Register POWCON1.
3.
Write Code 0xB1 to Register POWKEY4.
1 Divided clock for SPI/I2C0/I2C1 must be greater than or equal to the CPU clock
as selected by POWCON0 [2:0].
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PDF描述
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參數(shù)描述
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