參數(shù)資料
型號(hào)： AGL10002-FGG144I
元件分類： FPGA
英文描述： FPGA, 1000000 GATES, 200 MHz, PBGA144
封裝： 13 X 13 MM, 1 MM PITCH, ROHS COMPLIANT, FBGA-144
文件頁(yè)數(shù)： 2/204頁(yè)
文件大小： 2800K
代理商： AGL10002-FGG144I
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IGLOO Low-Power Flash FPGAs with Flash*Freeze Technology
1- 4
A dvanced v0. 1
Flash*Freeze Technology
The IGLOO device has an ultra-low power static mode,
called Flash*Freeze mode, which retains all SRAM and
register information and can still quickly return to
normal operation. Flash*Freeze technology enables the
user to quickly (within 1 s) enter and exit Flash*Freeze
mode by activating the Flash*Freeze pin while all power
supplies are kept at their original values. In addition, I/Os
and global I/Os can still be driven and can be toggling
without impact on power consumption, clocks can still
be driven or can be toggling without impact on power
consumption, and the device retains all core registers,
SRAM information, and states. I/O states are tristated
during Flash*Freeze mode or can be set to a certain state
using
weak
pull-up
or
pull-down
I/O
attribute
configuration. No power is consumed by the I/O banks,
clocks, JTAG pins, or PLL, and the device consumes as
little as 5 W in this mode.
Flash*Freeze technology allows the user to switch to
active mode on demand, thus simplifying the power
management of the device.
The Flash*Freeze pin (active low) can be routed internally
to the core to allow the user's logic to decide when it is
safe to transition to this mode. It is also possible to use the
Flash*Freeze pin as a regular I/O if Flash*Freeze mode
usage is not planned, which is advantageous because of
the inherent low power static (as low as 25 W) and
dynamic capabilities of the IGLOO device. Refer to
for
an
illustration
of
entering/exiting
Flash*Freeze mode. For more information on how to use
Flash*Freeze capability and other low power modes, refer
Figure 1-2 IGLOO Device Architecture Overview with Four I/O Banks (AGL250, AGL600, and AGL1000)
ISP AES
Decryption*
User Nonvolatile
FlashRom
Flash*Freeze
Technology
Charge
Pumps
RAM Block
4,608-Bit Dual-Port
SRAM or FIFO Block
(AGL600 and AGL1000)
RAM Block
4,608-Bit Dual-Port
SRAM or FIFO Block
VersaTile
CCC
I/Os
Bank 0
Bank
3
Bank
3
Bank
1
Bank
1
Bank 2
Figure 1-3 IGLOO Flash*Freeze Mode
Actel IGLOO
FPGA
Flash*Freeze
Mode Control
Flash*Freeze Pin
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PDF描述
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