參數資料
型號: AGLN030V2-ZFVQ100
元件分類: FPGA
英文描述: FPGA, PQFP100
封裝: 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, VQFP-100
文件頁數: 102/114頁
文件大?。?/td> 3991K
代理商: AGLN030V2-ZFVQ100
IGLOO nano DC and Switching Characteristics
2- 74
Advance v0.2
Table 2-95 RAM512X18
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V
Parameter
Description
Std. Units
tAS
Address setup time
0.83
ns
tAH
Address hold time
0.16
ns
tENS
REN_B, WEN_B setup time
0.73
ns
tENH
REN_B, WEN_B hold time
0.08
ns
tDS
Input data (DI) setup time
0.71
ns
tDH
Input data (DI) hold time
0.36
ns
tCKQ1
Clock HIGH to new data valid on DO (output retained, WMODE = 0)
4.21
ns
tCKQ2
Clock HIGH to new data valid on DO (pipelined)
1.71
ns
tC2CRWH
Address collision clk-to-clk delay for reliable read access after write on same address;
applicable to opening edge
0.35
ns
tC2CWRH
Address collision clk-to-clk delay for reliable write access after read on same address;
applicable to opening edge
0.42
ns
tRSTBQ
RESET_B LOW to data out LOW on DO (flow-through)
2.06
ns
RESET_B LOW to data out LOW on DO (pipelined)
2.06
ns
tREMRSTB
RESET_B removal
0.61
ns
tRECRSTB
RESET_B recovery
3.21
ns
tMPWRSTB
RESET_B minimum pulse width
0.68
ns
tCYC
Clock cycle time
6.24
ns
FMAX
Maximum frequency
160
MHz
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating
values.
相關PDF資料
PDF描述
AGLN030V2-ZFVQG100 FPGA, PQFP100
AGLN250V2-FCS81 FPGA, PBGA81
AGLN250V2-FCSG81 FPGA, PBGA81
AGLN250V2-FQN100 FPGA, PBCC100
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相關代理商/技術參數
參數描述
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