Revision 17 2-51 DDR Module Specifications Note: DDR is not supported for" />
參數(shù)資料
型號： AGLN030V2-ZVQ100I
廠商： Microsemi SoC
文件頁數(shù)： 115/150頁
文件大?。?/td> 0K
描述： IC FPGA NANO 1KB 30K 100VQFP
標準包裝： 90
系列： IGLOO nano
邏輯元件/單元數(shù)： 768
輸入/輸出數(shù)： 77
門數(shù)： 30000
電源電壓： 1.14 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-VQFP（14x14）
IGLOO nano Low Power Flash FPGAs
Revision 17
2-51
DDR Module Specifications
Note: DDR is not supported for AGLN010, AGLN015, and AGLN020 devices.
Input DDR Module
Figure 2-17 Input DDR Timing Model
Table 2-78 Parameter Definitions
Parameter Name
Parameter Definition
Measuring Nodes (from, to)
tDDRICLKQ1
Clock-to-Out Out_QR
B, D
tDDRICLKQ2
Clock-to-Out Out_QF
B, E
tDDRISUD
Data Setup Time of DDR input
A, B
tDDRIHD
Data Hold Time of DDR input
A, B
tDDRICLR2Q1
Clear-to-Out Out_QR
C, D
tDDRICLR2Q2
Clear-to-Out Out_QF
C, E
tDDRIREMCLR
Clear Removal
C, B
tDDRIRECCLR
Clear Recovery
C, B
Input DDR
Data
CLK
CLKBUF
INBUF
Out_QF
(to core)
FF2
FF1
INBUF
CLR
DDR_IN
E
A
B
C
D
Out_QR
(to core)
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PDF描述
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