參數資料
型號： AGLN125V5-QN100
元件分類： FPGA
英文描述： FPGA, PBCC100
封裝： 8 X 8 MM, 0.85 HEIGHT, 0.50 MM PITCH, QFN-100
文件頁數： 52/114頁
文件大小： 3991K
代理商： AGLN125V5-QN100
IGLOO nano DC and Switching Characteristics
2- 28
Advance v0.2
3.3 V LVCOMOS Wide Range
Table 2-39 Minimum and Maximum DC Input and Output Levels for LVCMOS 3.3 V Wide Range
3.3 V LVCMOS
Wide Range
VIL
VIH
VOL
VOH
IOL
IOH
IIL
1
IIH
2
Drive
Strength
Min., V
Max., V
Min., V
Max., V
Min., V
A
A3
All 4
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100
10
Notes:
1. IIL is the input leakage current per I/O pin over recommended operating conditions where –0.3 < VIN < VIL.
2. IIH is the input leakage current per I/O pin over recommended operating conditions where VIH < VIN < VCCI.
Input current is larger when operating outside recommended ranges.
3. Currents are measured at 85°C junction temperature.
4. All LVCMOS 3.3 V software macros support LVCMOS 3.3 V Wide Range, as specified in the JEDEC JESD8-B
specification.
相關PDF資料
PDF描述
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AGLN125V5-QNG100 FPGA, PBCC100
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AGLN125V5-ZFCSG81 FPGA, PBGA81
AGLN125V5-ZFQN100 FPGA, PBCC100
相關代理商/技術參數
參數描述
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