參數(shù)資料
型號： AGLN125V5-ZFCS81
元件分類： FPGA
英文描述： FPGA, PBGA81
封裝： 5 X 5 MM, 0.80 MM HEIGHT, 0.50 MM PITCH, CSP-81
文件頁數(shù)： 81/114頁
文件大?。?/td> 3991K
代理商： AGLN125V5-ZFCS81
IGLOO nano DC and Switching Characteristics
Ad vance v0.2
2-55
Timing Characteristics
1.5 V DC Core Voltage
1.2 V DC Core Voltage
Table 2-76 Combinatorial Cell Propagation Delays
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V
Combinatorial Cell
Equation
Parameter
Std.
Units
INV
Y = !A
tPD
0.76
ns
AND2
Y = A B
tPD
0.87
ns
NAND2
Y = !(A B)
tPD
0.91
ns
OR2
Y = A + B
tPD
0.90
ns
NOR2
Y = !(A + B)
tPD
0.94
ns
XOR2
Y = A
⊕ Bt
PD
1.39
ns
MAJ3
Y = MAJ(A, B, C)
tPD
1.44
ns
XOR3
Y = A
⊕ B ⊕ Ct
PD
1.60
ns
MUX2
Y = A !S + B S
tPD
1.17
ns
AND3
Y = A B C
tPD
1.18
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating
values.
Table 2-77 Combinatorial Cell Propagation Delays
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V
Combinatorial Cell
Equation
Parameter
Std.
Units
INV
Y = !A
tPD
1.33
ns
AND2
Y = A B
tPD
1.48
ns
NAND2
Y = !(A B)
tPD
1.58
ns
OR2
Y = A + B
tPD
1.53
ns
NOR2
Y = !(A + B)
tPD
1.63
ns
XOR2
Y = A
⊕ Bt
PD
2.34
ns
MAJ3
Y = MAJ(A, B, C)
tPD
2.59
ns
XOR3
Y = A
⊕ B ⊕ Ct
PD
2.74
ns
MUX2
Y = A !S + B S
tPD
2.03
ns
AND3
Y = A B C
tPD
2.11
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating
values.
相關PDF資料
PDF描述
AGLN125V5-ZFCSG81 FPGA, PBGA81
AGLN125V5-ZFQN100 FPGA, PBCC100
AGLN125V5-ZFQNG100 FPGA, PBCC100
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參數(shù)描述
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