參數(shù)資料
型號： AGLN250V2-FCS81
元件分類： FPGA
英文描述： FPGA, PBGA81
封裝： 5 X 5 MM, 0.80 MM HEIGHT, 0.50 MM PITCH, CSP-81
文件頁數(shù)： 88/114頁
文件大小： 3991K
代理商： AGLN250V2-FCS81
IGLOO nano DC and Switching Characteristics
Ad vance v0.2
2-61
Table 2-82 AGLN020 Global Resource
Commercial-Case Conditions: TJ = 70°C, VCC = 1.425 V
Parameter
Description
Std.
Units
Min.1
Max.2
tRCKL
Input LOW Delay for Global Clock
1.15
1.49
ns
tRCKH
Input HIGH Delay for Global Clock
1.16
1.59
ns
tRCKMPWH
Minimum Pulse Width HIGH for Global Clock
ns
tRCKMPWL
Minimum Pulse Width LOW for Global Clock
ns
tRCKSW
Maximum Skew for Global Clock
0.42
ns
FRMAX
Maximum Frequency for Global Clock
MHz
Notes:
1. Value reflects minimum load. The delay is measured from the CCC output to the clock pin of a sequential
element, located in a lightly loaded row (single element is connected to the global net).
2. Value reflects maximum load. The delay is measured on the clock pin of the farthest sequential element,
located in a fully loaded row (all available flip-flops are connected to the global net in the row).
3. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating
values.
Table 2-83 AGLN060 Global Resource
Commercial-Case Conditions: TJ = 70°C, VCC = 1.425 V
Parameter
Description
Std.
Units
Min.1
Max.2
tRCKL
Input LOW Delay for Global Clock
1.32
1.67
ns
tRCKH
Input HIGH Delay for Global Clock
1.34
1.76
ns
tRCKMPWH
Minimum Pulse Width HIGH for Global Clock
ns
tRCKMPWL
Minimum Pulse Width LOW for Global Clock
ns
tRCKSW
Maximum Skew for Global Clock
0.42
ns
FRMAX
Maximum Frequency for Global Clock
MHz
Notes:
1. Value reflects minimum load. The delay is measured from the CCC output to the clock pin of a sequential
element, located in a lightly loaded row (single element is connected to the global net).
2. Value reflects maximum load. The delay is measured on the clock pin of the farthest sequential element,
located in a fully loaded row (all available flip-flops are connected to the global net in the row).
3. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating
values.
相關PDF資料
PDF描述
AGLN250V2-FCSG81 FPGA, PBGA81
AGLN250V2-FQN100 FPGA, PBCC100
AGLN250V2-FQNG100 FPGA, PBCC100
AGLN250V2-FVQ100 FPGA, PQFP100
AGLN250V2-FVQG100 FPGA, PQFP100
相關代理商/技術參數(shù)
參數(shù)描述
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