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參數(shù)資料
| 型號： | Am27C1024-70PI5 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | Quad 2-input exclusive-NOR gates with open collector outputs 14-SOIC 0 to 70 |
| 中文描述： | 1兆位（65畝× 16位）的CMOS存儲器 |
| 文件頁數(shù)： | 2/12頁 |
| 文件大?。?/td> | 173K |
| 代理商： | AM27C1024-70PI5 |
2
Am27C1024
PRODUCT SELECTOR GUIDE
CONNECTION DIAGRAMS
DIP
PLCC
Notes:
1. JEDEC nomenclature is in parenthesis.
2.
Don’t use (DU) for PLCC.
PIN DESIGNATIONS
A0–A15
= Address Inputs
CE# (E#)
= Chip Enable Input
DQ0–DQ15 = Data Input/Outputs
OE# (G#)
= Output Enable Input
PGM# (P#)
= Program Enable Input
V
CC
V
PP
V
SS
NC
= V
CC
Supply Voltage
= Program Voltage Input
= Ground
= No Internal Connection
LOGIC SYMBOL
Family Part Number
Am27C1024
Speed Options
V
CC
= 5.0 V
±
5%
-55
-255
V
CC
= 5.0 V
±
10%
-55
-70
-90
-120
-150
-200
Max Access Time (ns)
55
70
90
120
150
200
250
CE# (E#) Access (ns)
55
70
90
120
150
200
250
OE# (G#) Access (ns)
40
40
45
50
65
75
75
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
22
21
V
CC
PGM# (P#)
NC
A15
A14
A13
A12
A11
A10
A9
V
SS
A8
A7
A6
A5
A4
A3
A2
A1
A0
V
PP
CE# (E#)
DQ15
DQ14
DQ13
DQ12
DQ11
DQ10
DQ9
DQ8
V
SS
DQ7
DQ6
DQ5
DQ4
DQ3
DQ2
DQ1
DQ0
OE# (G#)
06780J-2
1 44 43 42
5
4
3
2
6
41 40
7
8
9
10
11
12
13
14
15
16
17
A13
A12
A11
A10
A9
V
SS
NC
A8
A7
A6
A5
D
D
D
C
V
P
D
V
C
P
N
A
A
39
38
37
36
35
34
33
32
31
30
29
DQ12
DQ11
DQ10
DQ9
DQ8
V
SS
NC
DQ7
DQ6
DQ5
DQ4
D
D
D
D
O
D
A
A
A
A
A
23 24 25 26
19 20 21 22
18
27 28
06780J-3
16
16
DQ0–DQ15
A0–A15
CE# (E#)
OE# (G#)
06780J-4
PGM# (P#)
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PDF描述 |
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