ProASICPLUS Flash Family FPGAs 2- 52 v5.9 Table 2-48 Recommended Operati" />
參數(shù)資料
型號(hào): APA600-PQ208I
廠商: Microsemi SoC
文件頁(yè)數(shù): 138/178頁(yè)
文件大?。?/td> 0K
描述: IC FPGA PROASIC+ 600K 208-PQFP
標(biāo)準(zhǔn)包裝: 24
系列: ProASICPLUS
RAM 位總計(jì): 129024
輸入/輸出數(shù): 158
門數(shù): 600000
電源電壓: 2.3 V ~ 2.7 V
安裝類型: 表面貼裝
工作溫度: -40°C ~ 85°C
封裝/外殼: 208-BFQFP
供應(yīng)商設(shè)備封裝: 208-PQFP(28x28)
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)當(dāng)前第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)
ProASICPLUS Flash Family FPGAs
2- 52
v5.9
Table 2-48 Recommended Operating Conditions
Parameter
Symbol
Limits
Commercial/Industrial
Military/MIL-STD-883
Maximum Clock Frequency*
fCLOCK
180 MHz
Maximum RAM Frequency*
fRAM
150 MHz
Maximum Rise/Fall Time on Inputs*
Schmitt Trigger Mode (10% to 90%)
Non-Schmitt Trigger Mode (10% to
90%)
tR/tF
N/A
100 ns
10 ns
Maximum LVPECL Frequency*
180 MHz
Maximum TCK Frequency (JTAG)
fTCK
10 MHz
Table 2-49 Slew Rates Measured at C = 30pF, Nominal Power Supplies and 25°C
Type
Trig. Level
Rising Edge (ns)
Slew Rate (V/ns)
Falling Edge (ns)
Slew Rate (V/ns)
PCI Mode
OB33PH
10%-90%
1.60
1.65
1.60
Yes
OB33PN
10%-90%
1.57
1.68
3.32
0.80
No
OB33PL
10%-90%
1.57
1.68
1.99
1.32
No
OB33LH
10%-90%
3.80
0.70
4.84
0.55
No
OB33LN
10%-90%
4.19
0.63
3.37
0.78
No
OB33LL
10%-90%
5.49
0.48
2.98
0.89
No
OB25LPHH
10%-90%
1.55
1.29
1.56
1.28
No
OB25LPHN
10%-90%
1.70
1.18
2.08
0.96
No
OB25LPHL
10%-90%
1.97
1.02
2.09
0.96
No
OB25LPLH
10%-90%
3.57
0.56
3.93
0.51
No
OB25LPLN
10%-90%
4.65
0.43
3.28
0.61
No
OB25LPLL
10%-90%
5.52
0.36
3.44
0.58
No
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PDF描述
APA600-PQG208I IC FPGA PROASIC+ 600K 208-PQFP
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