參數(shù)資料
型號(hào)： AS5SS256K18DB-8
英文描述： x18 Fast Synchronous SRAM
中文描述： x18快速同步SRAM
文件頁(yè)數(shù)： 14/16頁(yè)
文件大小： 224K
代理商： AS5SS256K18DB-8
SRAM
AS5SS128K36
Austin Semiconductor, Inc.
AS5SS128K36
Rev. 2.0 12/00
Austin Semiconductor, Inc. reserves the right to change products or specifications without notice.
14
NOP, STALL AND DESELECT CYCLES
123
123
123
123
1234
1234
1234
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1234
A1
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1234
1234
1234
1234
1234
12345678901234567890123
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123
123
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A2
12
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12
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A3
123
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A4
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112345678901234
A5
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112345678901234
112345678901234
t
KHQZ
123
123
123
D(A1)
1234
1234
1234
1234
Q(A2)
123
123
123
123
Q(A3)
123
123
123
123
Q(A5)
12
12
12
12
WRITE
D(A1)
READ
Q(A2)
STALL
READ
Q(A3)
WRITE
D(A4)
STALL
NOP
READ
Q(A5)
DESELECT CONTINUE
DESELECT
123
123
123
Don’t Care
1234
1234
1234
1234
Undefined
CLK
CE\
ADV/LD\
R/W\
BWx\
ADDRESS
DQ
COMMAND
1
2 3 4 5 6 7 8 9 10
t
KHQX
1234
1234
1234
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1234
1234
CKE\
1234
1234
1234
1234
1234
1234
1234
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12345678
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1234567890
1234567890
123456789
123456789
123456789
123456789
123456789
123456789
12
12
12
12
12
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123456789
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12345678
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12
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12
12
12
12
12
12
12
12
D(A4)
NOP, STALL AND DESELECT TIMING PARAMETERS
-11
MIN
3.0
MAX
MIN
3.0
MAX
t
KHQX
t
KHQZ
5.0
5.0
SYMBOL
-12
NOTE:
1.
The IGNORE CLOCK EDGE or STALL cycle (clock 3) illustrates CKE\ being used to create a “pause”. A WRITE is not performed
during this cycle.
For this waveform, ZZ and OE\ are tied LOW.
CE\ represents three signals. When CE\ = 0, it represents CE\ = 0, CE2\ = 0, CE2 = 1.
Data coherency is provided for all possible operations. If a READ is initiated, the most current data is used. The most recent data
may be from the input data register.
2.
3.
4.
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