參數(shù)資料
型號(hào)： AT89C4051-12SU
廠(chǎng)商： Atmel
文件頁(yè)數(shù)： 6/19頁(yè)
文件大?。?/td> 0K
描述： IC 8051 MCU FLASH 4K 20SOIC
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 38
系列： 89C
核心處理器： 8051
芯體尺寸： 8-位
速度： 12MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，LED，POR
輸入/輸出數(shù)： 15
程序存儲(chǔ)器容量： 4KB（4K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 6 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 管件
14
1001F–MICRO–6/08
AT89C4051
21. Shift Register Mode Timing Waveforms
22. AC Testing Input/Output Waveforms
Note:
1. AC Inputs during testing are driven at V
CC - 0.5V for a logic 1 and 0.45V for a logic 0. Timing measurements are made at VIH
min. for a logic 1 and VIL max. for a logic 0.
23. Float Waveforms(1)
Note:
1. For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to
float when 100 mV change from the loaded VOH/VOL level occurs.
20. Serial Port Timing: Shift Register Mode Test Conditions
V
CC = 5.0V ± 20%; Load Capacitance = 80 pF
Symbol
Parameter
12 MHz Osc
Variable Oscillator
Units
Min
Max
Min
Max
tXLXL
Serial Port Clock Cycle Time
1.0
12tCLCL
s
t
QVXH
Output Data Setup to Clock Rising Edge
700
10t
CLCL-133
ns
tXHQX
Output Data Hold after Clock Rising Edge
50
2tCLCL-117
ns
tXHDX
Input Data Hold after Clock Rising Edge
0
ns
t
XHDV
Clock Rising Edge to Input Data Valid
700
10t
CLCL-133
ns
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PDF描述
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