參數(shù)資料
型號(hào)： AT89C5132-ROTIL
廠商： Atmel
文件頁數(shù)： 28/182頁
文件大?。?/td> 0K
描述： IC 8051 MCU FLASH 64K USB 80TQFP
標(biāo)準(zhǔn)包裝： 450
系列： AT89C513x
核心處理器： C52X2
芯體尺寸： 8-位
速度： 20MHz
連通性： IDE/ATAPI，I²C，MMC，PCM，SPI，UART/USART，USB
外圍設(shè)備： I²S，POR，WDT
輸入/輸出數(shù)： 44
程序存儲(chǔ)器容量： 64KB（64K x 8）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 4K x 8
RAM 容量： 2.25K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.3 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-LQFP
包裝： 托盤
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁當(dāng)前第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁
123
4173E–USB–09/07
AT89C5132
AT89C5132 captures data from the SI line while the selected slave captures data from the SO
line.
For simplicity, the following figures depict the SPI waveforms in idealized form and do not pro-
vide precise timing information. For timing parameters refer to the Section “AC Characteristics”.
Note:
1. When the peripheral is disabled (SPEN = 0), default SCK line is high level.
Figure 19-5. Data Transmission Format (CPHA = 0)
Figure 19-6. Data Transmission Format (CPHA = 1)
19.1.5
SS Management
Figure 19-5 shows an SPI transmission with CPHA = 0, where the first SCK edge is the MSB
capture point. Therefore the slave starts to output its MSB as soon as it is selected: SS asserted
to low level. SS must then be deasserted between each byte transmission (see Figure 19-7).
SPDAT must be loaded with data before SS is asserted again.
1
2
3
4
5
6
7
8
MSB
bit 1
LSB
bit 2
bit 4
bit 3
bit 6
bit 5
bit 1
bit 2
bit 4
bit 3
bit 6
bit 5
MSB
LSB
MOSI (from Master)
MISO (from Slave)
SCK (CPOL = 1)
SCK (CPOL = 0)
SPEN (Internal)
SCK Cycle Number
SS (to Slave)
to Capture Point
1
2
3
4
5
6
7
8
MSB
bit 1
LSB
bit 2
bit 4
bit 3
bit 6
bit 5
bit 1
bit 2
bit 4
bit 3
bit 6
bit 5
MSB
LSB
MOSI (from Master)
MISO (from Slave)
SCK (CPOL = 1)
SCK (CPOL = 0)
SPEN (Internal)
SCK Cycle Number
SS (to Slave)
Capture Point
相關(guān)PDF資料
PDF描述
PIC18F46K80-I/P MCU PIC 64KB FLASH 40DIP
AT89C5131A-RDTIL IC 8051 MCU FLASH 32K USB 64VQFP
PIC24EP64GP202-I/SP MCU 16BIT 64KB FLASH 28SPDIP
PIC24EP64MC202-I/SP MCU 16BIT 64KB FLASH 28SPDIP
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參數(shù)描述
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