參數(shù)資料
型號(hào)： AT89C5132-ROTUL
廠商： Atmel
文件頁(yè)數(shù)： 125/182頁(yè)
文件大?。?/td> 0K
描述： IC 8051 MCU FLASH 64K USB 80TQFP
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 450
系列： AT89C513x
核心處理器： C52X2
芯體尺寸： 8-位
速度： 20MHz
連通性： IDE/ATAPI，I²C，MMC，PCM，SPI，UART/USART，USB
外圍設(shè)備： I²S，POR，WDT
輸入/輸出數(shù)： 44
程序存儲(chǔ)器容量： 64KB（64K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
EEPROM 大小： 4K x 8
RAM 容量： 2.25K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.3 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-LQFP
包裝： 托盤(pán)
配用： AT89OCD-01-ND - USB EMULATOR FOR AT8XC51 MCU
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4173E–USB–09/07
AT89C5132
11.4.1
Entering Power-down Mode
To enter Power-down mode, set PD bit in PCON register. The AT89C5132 enters the Power-
down mode upon execution of the instruction that sets PD bit. The instruction that sets PD bit is
the last instruction executed.
11.4.2
Exiting Power-down Mode
If VDD was reduced during the Power-down mode, do not exit Power-down mode until VDD is
restored to the normal operating level.
There are 2 ways to exit the Power-down mode:
1.
Generate an enabled external interrupt.
–
The AT89C5132 provides capability to exit from Power-down using INT0, INT1, and
KIN3:0 inputs. In addition, using KIN input provides high or low level exit capability
(see Section “Keyboard Interface”, page 181).
Hardware clears PD bit in PCON register which starts the oscillator and restores the
clocks to the CPU and peripherals. Using INTn input, execution resumes when the
input is released (see Figure 11-3) while using KINx input, execution resumes after
counting 1024 clock ensuring the oscillator is restarted properly (see Figure 11-4).
This behavior is necessary for decoding the key while it is still pressed. In both
cases, execution resumes with the interrupt service routine. Upon completion of the
interrupt service routine, program execution resumes with the instruction
immediately following the instruction that activated Power-down mode.
Note:
1. The external interrupt used to exit Power-down mode must be configured as level sensitive
(
INT0 and INT1) and must be assigned the highest priority. In addition, the duration of the
interrupt must be long enough to allow the oscillator to stabilize. The execution will only
resume when the interrupt is deasserted.
2. Exit from power-down by external interrupt does not affect the SFRs nor the internal RAM
content.
Figure 11-3. Power-down Exit Waveform Using INT1:0
Figure 11-4. Power-down Exit Waveform Using KIN3:0
Note:
1. KIN3:0 can be high or low-level triggered.
2.
Generate a reset.
INT1:0
OSC
Power-down Phase
Oscillator Restart
Active Phase
Active phase
KIN3:01
OSC
Power-down
1024 clock count
Active phase
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