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參數(shù)資料
| 型號： | AT89C51RC2-RLRUM |
| 廠商： | Atmel |
| 文件頁數(shù)： | 108/127頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8051 32K FLASH 5V 44-VQFP |
| 產(chǎn)品培訓模塊： | MCU Product Line Introduction |
| 標準包裝： | 1 |
| 系列： | 89C |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 60MHz |
| 連通性： | SPI，UART/USART |
| 外圍設備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 32 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 44-LQFP |
| 包裝： | 標準包裝 |
| 其它名稱： | AT89C51RC2-RLRUMDKR |
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81
AT89C51RB2/RC2
4180E–8051–10/06
Table 1. Minimum Reset Capacitor Value for a 50 k
Ω Pull-down Resistor(1)
Note:
These values assume VDD starts from 0V to the nominal value. If the time between 2
on/off sequences is too fast, the power-supply de-coupling capacitors may not be fully
discharged, leading to a bad reset sequence.
Warm Reset
To achieve a valid reset, the reset signal must be maintained for at least 2 machine
cycles (24 oscillator clock periods) while the oscillator is running. The number of clock
periods is mode independent (X2 or X1).
Watchdog Reset
As detailed in Section “Hardware Watchdog Timer”, page 77, the WDT generates a 96-
clock period pulse on the RST pin. In order to properly propagate this pulse to the rest of
the application in case of external capacitor or power-supply supervisor circuit, a 1 k
Ω
resistor must be added as shown Figure 33.
Figure 33. Reset Circuitry for WDT Reset-out Usage
Oscillator
Start-Up Time
VDD Rise Time
1 ms
10 ms
100 ms
5 ms
820 nF
1.2 F
12 F
20 ms
2.7 F
3.9 F
12 F
R
RS
T
RST
VSS
To CPU Core
and Peripherals
VDD
+
P
VDD
From WDT
Reset Source
VSS
VDD
RST
1K
To Other
On-board
Circuitry
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參數(shù)描述 |
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| AT89C51RC2RLTUL | 制造商:Atmel Corporation 功能描述: |
| AT89C51RC2-RLTUL | 功能描述:8位微控制器 -MCU C51RC2 FLASH 32k 5V Ind RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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