參數(shù)資料
型號(hào)： AT89LP216-20PU
廠商： Atmel
文件頁(yè)數(shù)： 15/98頁(yè)
文件大?。?/td> 0K
描述： MCU 8051 2K FLASH 20MHZ 16-PDIP
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 30
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 14
程序存儲(chǔ)器容量： 2KB（2K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 16-DIP（0.300"，7.62mm）
包裝： 管件
22
3621E–MICRO–11/10
AT89LP216
13. I/O Ports
The AT89LP216 can be configured for between 11 and 14 I/O pins. The exact number of I/O
pins available depends on the clock and reset options as shown in Table 13-1. All port pins are
5V tolerant as inputs, that is they can be pulled up or driven to 5.5V even when operating at a
lower V
CC such as 3V. Inputs use CMOS levels while outputs use TTL levels. An external pul-
lup is required to convert outputs to CMOS levels.
13.1
Port Configuration
All port pins on the AT89LP216 may be configured to one of four modes: quasi-bidirectional
(standard 8051 port outputs), push-pull output, open-drain output, or input-only. Port modes may
be assigned in software on a pin-by-pin basis as shown in Table 13-2. The Tristate-Port User
Fuse determines the default state of the port pins. When the fuse is enabled, all port pins default
to input-only mode after reset, with the exception of P1.4 which starts in quasi-bidirectional
mode. When the fuse is disabled, all port pins, with the exception of P1.0 and P1.1, default to
quasi-bidirectional mode after reset and are weakly pulled high. Each port pin also has a
Schmitt-triggered input for improved input noise rejection. During Power-down all the Schmitt-
triggered inputs are disabled with the exception of P1.3, P3.2 and P3.3, which may be used to
wake up the device. Therefore P1.3, P3.2 and P3.3 should not be left floating during Power-
down.
Table 12-4.
IPH
– Interrupt Priority High Register
IPH = B7H
Reset Value = X000 0000B
Not Bit Addressable
–
PGH
PSH
PT1H
PX1H
PT0H
PX0H
Bit
7
6
543
21
0
Symbol
Function
PGH
General-purpose Interrupt Priority High
PSH
Serial Port Interrupt Priority High
PT1H
Timer 1 Interrupt Priority High
PX1H
External Interrupt 1 Priority High
PT0H
Timer 0 Interrupt Priority High
PX0H
External Interrupt 0 Priority High
Table 13-1.
I/O Pin Configurations
Clock Source
Reset Option
Number of I/O Pins
External Crystal or Resonator
External RST Pin
11
No external reset
12
External Clock
External RST Pin
12
No external reset
13
Internal RC Oscillator
External RST Pin
13
No external reset
14
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