參數資料
| 型號： | AT89LP216-20SU |
| 廠商： | Atmel |
| 文件頁數： | 68/98頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8051 2K FLASH 20MHZ 16-SOIC |
| 產品培訓模塊： | MCU Product Line Introduction |
| 標準包裝： | 46 |
| 系列： | 89LP |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數： | 14 |
| 程序存儲器容量： | 2KB（2K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 16-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
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3621E–MICRO–11/10
AT89LP216
24.4
Status Register
The current state of the memory may be accessed by reading the status register. The status reg-
ister is shown in Table 24-3.
24.5
DATA Polling
The AT89LP216 implements DATA polling to indicate the end of a programming cycle. While the
device is busy, any attempted read of the last byte written will return the data byte with the MSB
complemented. Once the programming cycle has completed, the true value will be accessible.
During Erase the data is assumed to be FFH and DATA polling will return 7FH. When writing
multiple bytes in a page, the DATA value will be the last data byte loaded before programming
begins, not the written byte with the highest physical address within the page.
24.6
Flash Security
The AT89LP216 provides two Lock Bits for Flash Code Memory security. Lock bits can be left
unprogrammed (FFh) or programmed (00h) to obtain the protection levels listed in Table 24-4.
Lock bits can only be erased (set to FFh) by Chip Erase. Lock bit mode 2 disables programming
of all memory spaces, including the User Signature Array and User Configuration Fuses. User
fuses must be programmed before enabling Lock bit mode 2 or 3. Lock bit mode 3 implemented
mode 2 and also blocks reads from the code memory; however, reads of the User Signature
Array, Atmel Signature Array, and User Configuration Fuses are still allowed.
Table 24-3.
Status
Register
–
LOAD
SUCCESS
WRTINH
BUSY
Bit
7
6
543
21
0
Symbol
Function
LOAD
Load flag. Cleared low by the load page buffer command and set high by the next memory write. This flag signals that
the page buffer was previously loaded with data by the load page buffer command.
SUCCESS
Success flag. Cleared low at the start of a programming cycle and will only be set high if the programming cycle
completes without interruption from the brownout detector.
WRTINH
Write Inhibit flag. Cleared low by the brownout detector (BOD) whenever programming is inhibited due to VCC falling
below the minimum required programming voltage. If a BOD episode occurs during programming, the SUCCESS flag
will remain low after the cycle is complete. WRTINH low also forces BUSY low.
BUSY
Busy flag. Cleared low whenever the memory is busy programming or if write is currently inhibited.
Table 24-4.
Lock Bit Protection Modes
Program Lock Bits (by address)
Mode
00h
01h
Protection Mode
1
FFh
No program lock features
2
00h
FFh
Further programming of the Flash is disabled
3
00h
Further programming of the Flash is disabled and verify
(read) is also disabled; OCD is disabled
相關PDF資料 |
PDF描述 |
|---|---|
| AT89LP4052-20SU | IC 8051 MCU FLASH 4K 20SOIC |
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參數描述 |
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