參數(shù)資料
型號(hào)： AT89LP52-20JU
廠商： Atmel
文件頁數(shù)： 106/117頁
文件大?。?/td> 0K
描述： IC MCU 8051 8K FLASH SPI 44PLCC
標(biāo)準(zhǔn)包裝： 27
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： EBI/EMI，I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 36
程序存儲(chǔ)器容量： 8KB（8K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-LCC（J 形引線）
包裝： *
89
3709D–MICRO–12/11
AT89LP51/52
Figure 17-11. In-System Programming (ISP) Start Sequence
17.9.4
ISP Exit Sequence
Execute this sequence to exit ISP mode and resume CPU execution mode.
1.
Drive SCK low.
1.
Wait at least t
SSD.
2.
Tristate MOSI.
3.
Wait at least t
RHZ and bring RST low.
4.
Wait t
SSZ and tristate SCK.
Figure 17-12. In-System Programming (ISP) Exit Sequence
Note:
The waveforms on this page are not to scale.
17.9.5
Serial Peripheral Interface
The Serial Peripheral Interface (SPI) is a byte-oriented full-duplex synchronous serial communi-
cation channel. During In-System Programming, the programmer always acts as the SPI master
and the target device always acts as the SPI slave. The target device receives serial data on
MOSI and outputs serial data on MISO. The Programming Interface implements a standard
SPI Port with a fixed data order and For In-System Programming, bytes are transferred MSB
first as shown in Figure 17-13. The SCK phase and polarity follow SPI clock mode 0 (CPOL = 0,
CPHA = 0) where bits are sampled on the rising edge of SCK and output on the falling edge of
SCK. For more detailed timing information see Figure 17-14.
tSTL
VDD
RST
SCK
HIGH Z
MOSI
HIGH Z
MISO
XTAL1
tRLZ
tZSS
tSSE
VDD
RST
SCK
HIGH Z
MOSI
HIGH Z
MISO
XTAL1
tSSZ
tSSD
tRHZ
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PDF描述
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參數(shù)描述
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AT89LP6440-20JU 功能描述:8位微控制器 -MCU Single-Cycle 8051 64K ISP Flash RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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