參數(shù)資料
型號： AT89LS51-16PU
廠商： Atmel
文件頁數(shù)： 16/31頁
文件大小： 0K
描述： IC MCU 4K FLASH 16MHZ 40-DIP
產(chǎn)品培訓模塊： MCU Product Line Introduction
標準包裝： 10
系列： 89LS
核心處理器： 8051
芯體尺寸： 8-位
速度： 16MHz
連通性： UART/USART
外圍設(shè)備： WDT
輸入/輸出數(shù)： 32
程序存儲器容量： 4KB（4K x 8）
程序存儲器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 4 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 40-DIP（0.600"，15.24mm）
包裝： 管件
23
3053C–MICRO–6/08
AT89LS51
23. AC Characteristics
Under operating conditions, load capacitance for Port 0, ALE/PROG, and PSEN = 100 pF; load capacitance for all other
outputs = 80 pF.
23.1
External Program and Data Memory Characteristics
Symbol
Parameter
16 MHz Oscillator
Variable Oscillator
Units
Min
Max
Min
Max
1/tCLCL
Oscillator Frequency
0
16
MHz
t
LHLL
ALE Pulse Width
85
2t
CLCL-40
ns
tAVLL
Address Valid to ALE Low
22
tCLCL-40
ns
tLLAX
Address Hold After ALE Low
32
tCLCL-30
ns
t
LLIV
ALE Low to Valid Instruction In
150
4t
CLCL-100
ns
tLLPL
ALE Low to PSEN Low
32
tCLCL-30
ns
tPLPH
PSEN Pulse Width
142
3tCLCL-45
ns
t
PLIV
PSEN Low to Valid Instruction In
82
3t
CLCL-105
ns
tPXIX
Input Instruction Hold After PSEN
00
ns
tPXIZ
Input Instruction Float After PSEN
37
tCLCL-25
ns
t
PXAV
PSEN to Address Valid
75
t
CLCL-8
ns
tAVIV
Address to Valid Instruction In
207
5tCLCL-105
ns
tPLAZ
PSEN Low to Address Float
10
ns
t
RLRH
RD Pulse Width
275
6t
CLCL-100
ns
tWLWH
WR Pulse Width
275
6tCLCL-100
ns
t
RLDV
RD Low to Valid Data In
147
5t
CLCL-165
ns
t
RHDX
Data Hold After RD
00
ns
tRHDZ
Data Float After RD
65
2tCLCL-60
ns
t
LLDV
ALE Low to Valid Data In
350
8t
CLCL-150
ns
t
AVDV
Address to Valid Data In
397
9t
CLCL-165
ns
tLLWL
ALE Low to RD or WR Low
137
239
3tCLCL-50
3tCLCL+50
ns
t
AVWL
Address to RD or WR Low
122
4t
CLCL-130
ns
t
QVWX
Data Valid to WR Transition
13
t
CLCL-50
ns
tQVWH
Data Valid to WR High
287
7tCLCL-150
ns
t
WHQX
Data Hold After WR
13
t
CLCL-50
ns
t
RLAZ
RD Low to Address Float
0
ns
tWHLH
RD or WR High to ALE High
23
103
tCLCL-40
tCLCL+40
ns
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