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參數(shù)資料
| 型號： | ATT3030-100J44I |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | FPGA |
| 英文描述： | Field-Programmable Gate Arrays |
| 中文描述： | 現(xiàn)場可編程門陣列 |
| 文件頁數(shù)： | 48/80頁 |
| 文件大?。?/td> | 528K |
| 代理商： | ATT3030-100J44I |
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Data Sheet
February 1997
ATT3000 Series Field-Programmable Gate Arrays
48
Lucent Technologies Inc.
Pin Assignments
(continued)
Table 15. ATT3000 Family 175-Pin PPGA Pinout
175
PPGA
B2
D4
B3
C4
B4
A4
D5
C5
B5
A5
C6
D6
B6
A6
B7
C7
D7
A7
A8
B8
C8
D8
D9
C9
B9
A9
A10
D10
C10
B10
A11
B11
D11
C11
A12
B12
C12
D12
A13
B13
C13
A14
Function
175
PPGA
D13
B14
C14
B15
D14
C15
E14
B16
D15
C16
D16
F14
E15
E16
F15
F16
G14
G15
G16
H16
H15
H14
J14
J15
J16
K16
K15
K14
L16
L15
M16
M15
L14
N16
P16
N15
R16
M14
P15
N14
R15
P14
Function
175
PPGA
R14
N13
T14
P13
R13
T13
N12
P12
R12
T12
P11
N11
R11
T11
R10
P10
N10
T10
T9
R9
P9
N9
N8
P8
R8
T8
T7
N7
P7
R7
T6
R6
N6
P6
T5
R5
P5
N5
T4
R4
P4
—
Function
175
PPGA
R3
N4
R2
P3
N3
P2
M3
R1
N2
P1
N1
L3
M2
M1
L2
L1
K3
K2
K1
J1
J2
J3
H3
H2
H1
G1
G2
G3
F1
F2
E1
E2
F3
D1
C1
D2
B1
E3
C2
D3
C3
—
Function
PWRDWN
TCLKIN–I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
GND
V
CC
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
DONE–
PROG
D7–I/O
XTL1–BCLKIN–I/O
I/O
I/O
I/O
I/O
D6–I/O
I/O
I/O
I/O
I/O
I/O
D5–I/O
CS0
–I/O
I/O
I/O
I/O
I/O
D4–I/O
I/O
V
CC
GND
D3–I/O
CS1
–I/O
I/O
I/O
I/O
I/O
D2–I/O
I/O
I/O
I/O
I/O
I/O
D1–I/O
RDY
/
BUSY–RCLK–I/O
I/O
I/O
I/O
I/O
—
D0–DIN–I/O
DOUT–I/O
CCLK
V
CC
GND
A0–
WS
–I/O
A1–CS2–I/O
I/O
I/O
A2–I/O
A3–I/O
I/O
I/O
A15
–
I/O
A4–I/O
I/O
I/O
A14–I/O
A5–I/O
I/O
I/O
GND
V
CC
A13–I/O
A6–I/O
I/O
I/O
I/O
I/O
A12–I/O
A7–I/O
I/O
I/O
A11–I/O
A8–I/O
I/O
I/O
A10–I/O
A9–I/O
V
CC
GND
—
M1–
RDATA
GND
M0–RTRIG
V
CC
M2–I/O
HDC–I/O
I/O
I/O
I/O
LDC
–I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
INIT
–I/O
V
CC
GND
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
XTL2–I/O
GND
RESET
V
CC
Note:Unprogrammed IOBs have a default pull-up; this prevents an undefined pad level for unbonded or unused IOBs. Programmed
outputs are default slew-limited. Pins A2, A3, A15, A16, T1, T2, T3, T15, and T16 are not connected. Pin A1 does not exist.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ATT3030-100J68I | Field-Programmable Gate Arrays |
| ATT3030-100J84I | Field-Programmable Gate Arrays |
| ATT3030-100M132I | Field-Programmable Gate Arrays |
| ATT3030-100M44I | Field-Programmable Gate Arrays |
| ATT3030-100M68I | Field-Programmable Gate Arrays |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ATT3030-100J68I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| ATT3030-100J84I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| ATT3030-100M132I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| ATT3030-100M44I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
| ATT3030-100M68I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field-Programmable Gate Arrays |
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