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參數(shù)資料
| 型號(hào)： | ATTINY13A-SH |
| 廠商： | Atmel |
| 文件頁數(shù)： | 43/67頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU AVR 1K FLASH 20MHZ 8SOIC |
| 產(chǎn)品培訓(xùn)模塊： | MCU Product Line Introduction tinyAVR Introduction |
| 標(biāo)準(zhǔn)包裝： | 95 |
| 系列： | AVR® ATtiny |
| 核心處理器： | AVR |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 外圍設(shè)備： | 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 6 |
| 程序存儲(chǔ)器容量： | 1KB（512 x 16） |
| 程序存儲(chǔ)器類型： | 閃存 |
| EEPROM 大?。?/td> | 64 x 8 |
| RAM 容量： | 64 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 4x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 8-SOIC（0.209"，5.30mm 寬） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 612 (CN2011-ZH PDF) |
| 配用： | ATSTK600-ND - DEV KIT FOR AVR/AVR32 ATAVRDRAGON-ND - KIT DRAGON FLASH MEM AVR ATAVRISP2-ND - PROGRAMMER AVR IN SYSTEM ATJTAGICE2-ND - AVR ON-CHIP D-BUG SYSTEM |
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24
8126F–AVR–05/12
ATtiny13A
6.1.4
ADC Clock – clk
ADC
The ADC is provided with a dedicated clock domain. This allows halting the CPU and I/O clocks
in order to reduce noise generated by digital circuitry. This gives more accurate ADC conversion
results.
6.2
Clock Sources
The device has the following clock source options, selectable by Flash fuse bits as shown
below. The clock from the selected source is input to the AVR clock generator, and routed to the
appropriate modules.
Note:
1. For all fuses “1” means unprogrammed while “0” means programmed.
The various choices for each clocking option is given in the following sections. When the CPU
wakes up from Power-down or Power-save, the selected clock source is used to time the start-
up, ensuring stable Oscillator operation before instruction execution starts. When the CPU starts
from reset, there is an additional delay allowing the power to reach a stable level before com-
mencing normal operation. The Watchdog Oscillator is used for timing this real-time part of the
start-up time. The number of WDT Oscillator cycles used for each time-out is shown in Table 6-
6.2.1
External Clock
To drive the device from an external clock source, CLKI should be driven as shown in Figure 6-
2. To run the device on an external clock, the CKSEL fuses must be programmed to “00”.
Figure 6-2.
External Clock Drive Configuration
Table 6-1.
Device Clocking Options Select
Device Clocking Option
External Clock (see page 24)00
Calibrated Internal 4.8/9.6 MHz Oscillator (see page 25)01, 10
Internal 128 kHz Oscillator (see page 26)11
Table 6-2.
Number of Watchdog Oscillator Cycles
Typ Time-out
Number of Cycles
512
64 ms
8K (8,192)
EXTERNAL
CLOCK
SIGNAL
CLKI
GND
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PDF描述 |
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| ATTINY13A-SS7R | 功能描述:8位微控制器 -MCU AVR 1KB FL 64B EE 64B SRAM JEDEC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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