參數(shù)資料
型號： ATTINY24-20SSUR
廠商： Atmel
文件頁數(shù)： 123/238頁
文件大小： 0K
描述： MCU AVR 2KB FLASH 20MHZ 14SOIC
產品培訓模塊： tinyAVR Introduction
標準包裝： 3,000
系列： AVR® ATtiny
核心處理器： AVR
芯體尺寸： 8-位
速度： 20MHz
連通性： USI
外圍設備： 欠壓檢測/復位，POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 12
程序存儲器容量： 2KB（1K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 8x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-SOIC（0.154"，3.90mm 寬）
包裝： 帶卷 (TR)
其它名稱： ATTINY24-20SSUR-ND
ATTINY24-20SSURTR
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2001 Microchip Technology Inc.
DS39026C-page 207
PIC18CXX2
DECFSZ
Decrement f, skip if 0
Syntax:
[ label ] DECFSZ f [,d [,a]]
Operands:
0
≤ f ≤ 255
d
∈ [0,1]
a
∈ [0,1]
Operation:
(f) – 1
→ dest,
skip if result = 0
Status Affected:
None
Encoding:
0010
11da
ffff
Description:
The contents of register 'f' are
decremented. If 'd' is 0, the result is
placed in WREG. If 'd' is 1, the
result is placed back in register 'f'
(default).
If the result is 0, the next instruc-
tion, which is already fetched, is
discarded and a NOP is executed
instead, making it a two-cycle
instruction. If ’a’ is 0, the Access
Bank will be selected, overriding
the BSR value. If ’a’ = 1, then the
bank will be selected as per the
BSR value (default).
Words:
1
Cycles:
1(2)
Note: 3 cycles if skip and followed
by a 2-word instruction.
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Read
register ’f’
Process
Data
Write to
destination
If skip:
Q1
Q2
Q3
Q4
No
operation
No
operation
No
operation
No
operation
If skip and followed by 2-word instruction:
Q1
Q2
Q3
Q4
No
operation
No
operation
No
operation
No
operation
No
operation
No
operation
No
operation
No
operation
Example:
HERE
DECFSZ
CNT, 1, 1
GOTO
LOOP
CONTINUE
Before Instruction
PC
=
Address (HERE)
After Instruction
CNT
=
CNT - 1
If CNT
=
0;
PC
=
Address (CONTINUE)
If CNT
≠
0;
PC
=
Address (HERE+2)
DCFSNZ
Decrement f, skip if not 0
Syntax:
[label] DCFSNZ
f [,d [,a]
Operands:
0
≤ f ≤ 255
d
∈ [0,1]
a
∈ [0,1]
Operation:
(f) – 1
→ dest,
skip if result
≠ 0
Status Affected:
None
Encoding:
0100
11da
ffff
Description:
The contents of register 'f' are dec-
remented. If 'd' is 0, the result is
placed in WREG. If 'd' is 1, the
result is placed back in register 'f'
(default).
If the result is not 0, the next
instruction, which is already
fetched, is discarded and a NOP is
executed instead, making it a two-
cycle instruction. If ’a’ is 0, the
Access Bank will be selected,
overriding the BSR value. If ’a’ = 1,
then the bank will be selected as
per the BSR value (default).
Words:
1
Cycles:
1(2)
Note: 3 cycles if skip and followed
by a 2-word instruction.
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Read
register ’f’
Process
Data
Write to
destination
If skip:
Q1
Q2
Q3
Q4
No
operation
No
operation
No
operation
No
operation
If skip and followed by 2-word instruction:
Q1
Q2
Q3
Q4
No
operation
No
operation
No
operation
No
operation
No
operation
No
operation
No
operation
No
operation
Example:
HERE
DCFSNZ
TEMP, 1, 0
ZERO
:
NZERO
:
Before Instruction
TEMP
=
?
After Instruction
TEMP
=
TEMP - 1,
If TEMP
=
0;
PC
=
Address (ZERO)
If TEMP
≠
0;
PC
=
Address (NZERO)
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PDF描述
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參數(shù)描述
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ATTINY24A-CCU 功能描述:8位微控制器 -MCU AVR 2KB FL 128B EE USI ADC 20MHz IND RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT
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