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參數(shù)資料
| 型號： | ATTINY861A-MU |
| 廠商： | Atmel |
| 文件頁數(shù)： | 96/296頁 |
| 文件大小： | 0K |
| 描述： | MCU AVR 8K FLASH 15MHZ 32-QFN |
| 標(biāo)準(zhǔn)包裝： | 490 |
| 系列： | AVR® ATtiny |
| 核心處理器： | AVR |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | USI |
| 外圍設(shè)備： | 欠壓檢測/復(fù)位，POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 16 |
| 程序存儲(chǔ)器容量： | 8KB（4K x 16） |
| 程序存儲(chǔ)器類型： | 閃存 |
| EEPROM 大?。?/td> | 512 x 8 |
| RAM 容量： | 512 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 11x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 32-VFQFN 裸露焊盤 |
| 包裝： | 托盤 |
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2000 Microchip Technology Inc.
Advanced Information
DS30475A-page 185
PIC18CXX8
17.2
Control Registers for the CAN Module
There are many registers associated with the CAN
module. Descriptions of these registers are grouped
into sections. These sections are:
Control and Status Registers
Transmit Buffer Registers
Receive Buffer Registers
Baud Rate Control Registers
Interrupt Status and Control Registers
17.2.1
CAN CONTROL AND STATUS REGISTERS
This section shows the CAN Control and Status
registers.
REGISTER 17-1:
CANCON – CAN CONTROL REGISTER
Note:
Not all CAN registers are available in the
access bank.
R/W-1
R/W-0
U-0
REQOP2
REQOP1
REQOP0
ABAT
WIN2
WIN1
WIN0
—
bit 7
bit 0
bit 7-5
REQOP2:REQOP0: Request CAN Operation Mode bits
1xx
= Request Configuration mode
011
= Request Listen Only mode
010
= Request Loopback mode
001
= Request Disable mode
000
= Request Normal mode
bit 4
ABAT: Abort All Pending Transmissions bit
1 = Abort all pending transmissions (in all transmit buffers)
0 = Transmissions proceeding as normal
bit 3-1
WIN2:WIN0: Window Address bits
This selects which of the CAN buffers to switch into the access bank area. This allows access
to the buffer registers from any data memory bank. After a frame has caused an interrupt, the
ICODE2:ICODE0 bits can be copied to the WIN2:WIN0 bits to select the correct buffer. See
Example 17-1 for code example.
111
= Receive Buffer 0
110
= Receive Buffer 0
101
= Receive Buffer 1
100
= Transmit Buffer 0
011
= Transmit Buffer 1
010
= Transmit Buffer 2
001
= Receive Buffer 0
000
= Receive Buffer 0
bit 0
Unimplemented: Read as ’0’
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
- n = Value at POR
’1’ = Bit is set
’0’ = Bit is cleared
x = Bit is unknown
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