參數(shù)資料
型號： ATXMEGA256A3B-AUR
廠商： Atmel
文件頁數(shù)： 152/287頁
文件大?。?/td> 0K
描述： IC MCU 8BIT 256KB FLASH 64TQFP
標準包裝： 1,000
系列： AVR® XMEGA
核心處理器： AVR
芯體尺寸： 8/16-位
速度： 32MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，DMA，POR，PWM，WDT
輸入/輸出數(shù)： 49
程序存儲器容量： 256KB（128K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 4K x 8
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 1.6 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b; D/A 2x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 帶卷 (TR)
配用： ATSTK600-RC14-ND - STK600 SOCKET/ADAPTER 64TQFP
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2011 Microchip Technology Inc.
DS39932D-page 335
PIC18F46J11 FAMILY
20.1.3
AUTO-BAUD RATE DETECT
The Enhanced USART module supports the automatic
detection and calibration of baud rate. This feature is
active only in Asynchronous mode and while the WUE
bit is clear.
The automatic baud rate measurement sequence
(Figure 20-1) begins whenever a Start bit is received
and the ABDEN bit is set. The calculation is
self-averaging.
In the Auto-Baud Rate Detect (ABD) mode, the clock to
the BRG is reversed. Rather than the BRG clocking the
incoming RXx signal, the RXx signal is timing the BRG.
In ABD mode, the internal BRG is used as a counter to
time the bit period of the incoming serial byte stream.
Once the ABDEN bit is set, the state machine will clear
the BRG and look for a Start bit. The ABD must receive
a byte with the value, 55h (ASCII “U”, which is also the
LIN/J2602 bus Sync character), in order to calculate the
proper bit rate. The measurement is taken over both a
low and high bit time in order to minimize any effects
caused by asymmetry of the incoming signal. After a
Start bit, the SPBRGx begins counting up, using the pre-
selected clock source on the first rising edge of RXx.
After eight bits on the RXx pin or the fifth rising edge, an
accumulated value totaling the proper BRG period is left
in the SPBRGHx:SPBRGx register pair. Once the 5th
edge is seen (this should correspond to the Stop bit), the
ABDEN bit is automatically cleared.
If a rollover of the BRG occurs (an overflow from FFFFh
to 0000h), the event is trapped by the ABDOVF status
bit (BAUDCONx<7>). It is set in hardware by BRG roll-
overs and can be set or cleared by the user in software.
ABD mode remains active after rollover events and the
ABDEN bit remains set (Figure 20-2).
While calibrating the baud rate period, the BRG
registers are clocked at 1/8th the preconfigured clock
rate. Note that the BRG clock can be configured by the
BRG16 and BRGH bits. The BRG16 bit must be set to
use both SPBRG1 and SPBRGH1 as a 16-bit counter.
This allows the user to verify that no carry occurred for
8-bit modes by checking for 00h in the SPBRGHx
register.
Refer to Table 20-4 for counter clock rates to the BRG.
While the ABD sequence takes place, the EUSART
state machine is held in Idle. The RCxIF interrupt is set
once the fifth rising edge on RXx is detected. The value
in the RCREGx needs to be read to clear the RCxIF
interrupt. The contents of RCREGx should be
discarded.
TABLE 20-4:
BRG COUNTER
CLOCK RATES
20.1.3.1
ABD and EUSART Transmission
Since the BRG clock is reversed during ABD acquisi-
tion, the EUSART transmitter cannot be used during
ABD. This means that whenever the ABDEN bit is set,
TXREGx cannot be written to. Users should also
ensure that ABDEN does not become set during a
transmit sequence. Failing to do this may result in
unpredictable EUSART operation.
Note 1:
If the WUE bit is set with the ABDEN bit,
Auto-Baud Rate Detection will occur on
the byte following the Break character.
2:
It is up to the user to determine that the
incoming character baud rate is within the
range of the selected BRG clock source.
Some
combinations
of
oscillator
frequency and EUSART baud rates are
not possible due to bit error rates. Overall
system timing and communication baud
rates must be taken into consideration
when using the Auto-Baud Rate Detection
feature.
3:
To maximize the baud rate range, it is
recommended to set the BRG16 bit if the
auto-baud feature is used.
BRG16
BRGH
BRG Counter Clock
00
FOSC/512
01
FOSC/128
10
FOSC/128
11
FOSC/32
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PDF描述
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