參數(shù)資料
型號(hào)： AX250-2FG484
元件分類： FPGA
英文描述： FPGA, 2816 CLBS, 154000 GATES, 870 MHz, PBGA484
封裝： 1 MM PITCH, FBGA-484
文件頁(yè)數(shù)： 90/230頁(yè)
文件大?。?/td> 6485K
代理商： AX250-2FG484
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Axcelerator Family FPGAs
2- 4
v2.8
Ptotal = Pdc + Pac
PHCLK = (P1 + P2 * s + P3 * sqrt[s]) * Fs
PCLK = (P4 + P5 * s + P6 * sqrt[s]) * Fs
PR-cells = P7 * ms * Fs
PC-cells = P8 * mc * Fs
Pinputs = P9 * pi * Fpi
Poutputs = PI/O * po * Fpo
Pmemory = P11 * Nblock * FRCLK + P12 * Nblock * FWCLK
PPLL = P13 * FCLK
Pdc =ICCA * VCCA
Pac =PHCLK + PCLK + PR-cells + PC-cells + Pinputs + Poutputs + Pmemory + PPLL
s
= the number of R-cells clocked by this clock
Fs
= the clock frequency
s
= the number of R-cells clocked by this clock
Fs
= the clock frequency
ms
=
the number of R-cells switching at each Fs cycle
Fs
=
the clock frequency
mc =
the number of C-cells switching at each Fs cycle
Fs
=
the clock frequency
pi
= the number of inputs
Fpi = the average input frequency
Cload = the output load (technology dependent)
VCCI
= the output voltage (technology dependent)
po
= the number of outputs
Fpo
= the average output frequency
Nblock = the number of RAM/FIFO blocks (1 block = 4k)
FRCLK = the read-clock frequency of the memory
FWCLK = the write-clock frequency of the memory
FRefCLK = the clock frequency of the clock input of the PLL
FCLK
= the clock frequency of the first clock output of the PLL
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PDF描述
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AX250-2FG896 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs
AX250-2FG896B 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs
AX250-2FG896I 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs
AX250-2FG896M 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Axcelerator Family FPGAs
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