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參數(shù)資料
| 型號(hào)： | AX250-2FG484I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 241/262頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA AXCELERATOR 250K 484FBGA |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | Axcelerator |
| 邏輯元件/單元數(shù)： | 2816 |
| RAM 位總計(jì)： | 55296 |
| 輸入/輸出數(shù)： | 248 |
| 門數(shù)： | 250000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 484-BGA |
| 供應(yīng)商設(shè)備封裝： | 484-FPBGA（23x23） |
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General Description
1- 2
R ev isio n 1 8
Logic Modules
Microsemi's Axcelerator family provides two types of logic modules: the register cell (R-cell) and the
combinatorial cell (C-cell). The Axcelerator device can implement more than 4,000 combinatorial
functions of up to five inputs (Figure 1-3).
The R-cell contains a flip-flop featuring asynchronous clear, asynchronous preset, and active-low enable
control signals (Figure 1-3). The R-cell registers feature programmable clock polarity selectable on a
register-by-register basis. This provides additional flexibility (e.g., easy mapping of dual-data-rate
functions into the FPGA) while conserving valuable clock resources. The clock source for the R-cell can
be chosen from the hardwired clocks, routed clocks, or internal logic.
Figure 1-2
Axcelerator Family Interconnect Elements
Figure 1-3
AX C-Cell and R-Cell
C-cell
A[1:0]
B[1:0]
D[3:0]
DB
CFN
FCO
FCI
Y
PSET
CLR
D
E
CLK
Q
(Positive Edge Triggered)
C-Cell
R-Cell
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