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參數(shù)資料
| 型號(hào)： | BD3872FS-E2 |
| 廠商： | Rohm Semiconductor |
| 文件頁(yè)數(shù)： | 3/7頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC SOUND PROCESSOR SSOP-A32 |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 類型： | 音頻處理器 |
| 應(yīng)用： | 音頻系統(tǒng) |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-SOP（0.209"，5.30mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-SSOPA |
| 包裝： | 帶卷 (TR) |
Technical Note
3/15
www.rohm.com
2010.10 - Rev.A
2010 ROHM Co., Ltd. All rights reserved.
BD3870FS,BD3871FS,BD3872FS,BD3873FS
SC
(CLOCK)
thd
th
ts
ts1
th1
tsd
twc
twh
twd
tw1
tsu
DATA
LATCH
90%
10%
90%
10%
twc
End with Low
SI
DATA
LATCH
●
Timing chart
1) Signal Timing Conditions
·
Data is read on the rising edge of the clock.
·
Latch is read out on the falling edge of the clock.
·
Latch signal must end with the LOW state.
·
To avoid malfunctions, clock and data signals must terminate with the LOW state.
1byte=10bit
Fig.1
Parameter
Symbol
Limits
Unit
Min.
Typ.
Max.
Minimum Clock Width
Twc
2.0
-
s
Minimum Data Width
twd
2.0
-
s
Minimum Latch Width
Tw1
2.0
-
s
Data Set-up Time (DATA
CLK)
Tsd
1.0
-
s
Data Hold Time (CLK
DATA)
Thd
1.0
-
s
Latch Set-up Time (CLK
LATCH)
Ts1
1.0
-
s
Latch Hold Time (DATA
LATCH)
Th1
1.0
-
s
Latch Low Set-up Time
Ts
1.0
-
s
Latch Low Hold Width
Twh
2.0
-
s
2) Voltage Conditions for Control Signals
Parameter
Limits
Unit
Condition
Min.
Typ.
Max.
(≦Vcc)
“H” Input Voltage
2.2
-
5.5
V
Vcc=4.5 to 9.5V
“L” Input Voltage
0
-
1.0
V
Vcc=4.5 to 9.5V
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| BD3883FS-E2 | IC AUDIO SOUND CONTRLR SSOP-A32 |
| BD5413EFV-E2 | IC AMP AUDIO PWR 5W STER 24TSSOP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| BD3881FV_1 | 制造商:ROHM 制造商全稱:Rohm 功能描述:Audio sound controller |
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