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參數(shù)資料
| 型號(hào)： | BU-62864G3-160K |
| 廠商： | DATA DEVICE CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQFP72 |
| 封裝： | 1 INCH, CERAMIC, QFP-72 |
| 文件頁(yè)數(shù)： | 6/99頁(yè) |
| 文件大?。?/td> | 578K |
| 代理商： | BU-62864G3-160K |
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Data Device Corporation
62743_pre7_noSA-DB.DOC
www.ddc-web.com
8-07-02
14
PCI Command register
Table 5. PCI Command Register
BIT
DESCRIPTION
15:10
Reserved, 0s
9
0
8
SERR# Enable
7
0
6
Parity Error Control
5:2
0
1
Memory Space
0 (LSB)
0
Reserved: These bits are read-only and return zeroes when read.
SERR# Enable: This is an enable bit for the SERR# driver. A value of 0b
disables the driver. A value of 1b enables the driver. The value after RST# is 0b.
Parity Error Control: This bit controls the device’s response to parity errors.
When the bit is 1b, the device will take its normal action when a parity error is
detected. When this bit is 0b, the device will ignore any parity errors that it
detects and continue normal operation. The value after RST# is 0b.
Memory Space: This bit controls the device’s response to memory space
accesses. A value of 0b disables the device response. A value of 1b allows the
device to respond to memory space accesses. The value after RST# is 0b.
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