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參數(shù)資料
| 型號(hào)： | C8051F340-TB |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 100/276頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD PROTOTYPING W/C8051F340 |
| 應(yīng)用說明： | TCP/IP Library Programmers Guide, Appl Note AN237 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | C8051F340 |
| 所含物品： | 板 |
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Rev. 1.3
189
C8051F340/1/2/3/4/5/6/7/8/9/A/B/C/D
17.1. Supporting Documents
It is assumed the reader is familiar with or has access to the following supporting documents:
1.
The I2C-Bus and How to Use It (including specifications), Philips Semiconductor.
2.
The I2C-Bus Specification -- Version 2.0, Philips Semiconductor.
3.
System Management Bus Specification -- Version 1.1, SBS Implementers Forum.
17.2. SMBus Configuration
Figure 17.2 shows a typical SMBus configuration. The SMBus specification allows any recessive voltage
between 3.0 V and 5.0 V; different devices on the bus may operate at different voltage levels. The bi-direc-
tional SCL (serial clock) and SDA (serial data) lines must be connected to a positive power supply voltage
through a pull-up resistor or similar circuit. Every device connected to the bus must have an open-drain or
open-collector output for both the SCL and SDA lines, so that both are pulled high (recessive state) when
the bus is free. The maximum number of devices on the bus is limited only by the requirement that the rise
and fall times on the bus not exceed 300 ns and 1000 ns, respectively.
Figure 17.2. Typical SMBus Configuration
17.3. SMBus Operation
Two types of data transfers are possible: data transfers from a master transmitter to an addressed slave
receiver (WRITE), and data transfers from an addressed slave transmitter to a master receiver (READ).
The master device initiates both types of data transfers and provides the serial clock pulses on SCL. The
SMBus interface may operate as a master or a slave, and multiple master devices on the same bus are
supported. If two or more masters attempt to initiate a data transfer simultaneously, an arbitration scheme
is employed with a single master always winning the arbitration. Note that it is not necessary to specify one
device as the Master in a system; any device who transmits a START and a slave address becomes the
master for the duration of that transfer.
A typical SMBus transaction consists of a START condition followed by an address byte (Bits7-1: 7-bit
slave address; Bit0: R/W direction bit), one or more bytes of data, and a STOP condition. Each byte that is
received (by a master or slave) must be acknowledged (ACK) with a low SDA during a high SCL (see
Figure 17.3). If the receiving device does not ACK, the transmitting device will read a NACK (not acknowl-
edge), which is a high SDA during a high SCL.
VDD = 5V
Master
Device
Slave
Device 1
Slave
Device 2
VDD = 3V
VDD = 5V
VDD = 3V
SDA
SCL
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PDF描述 |
|---|---|
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參數(shù)描述 |
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| C8051F341-GQR | 功能描述:8位微控制器 -MCU 48 MIPS 32KB 10ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| C8051F342 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Full Speed USB Flash MCU Family |
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