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參數資料
| 型號： | C8051F536A-IT |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 195/220頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 2K FLASH 20TSSOP |
| 產品培訓模塊： | Serial Communication Overview |
| 標準包裝： | 74 |
| 系列： | C8051F53x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 25MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數： | 16 |
| 程序存儲器容量： | 2KB（2K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.25 V |
| 數據轉換器： | A/D 16x12b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 包裝： | 管件 |
| 配用： | 336-1488-ND - KIT DEV C8051F53XA, C8051F52XA 336-1457-ND - ADAPTER PROG TOOLSTICK F530TPP 336-1456-ND - ADAPTER PROG TOOLSTICK F530MPP |
| 其它名稱： | 336-1502-5 |
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C8051F52x/F53x
76
Rev. 1.4
7. Comparator
C8051F52x/F52xA/F53x/F53xA devices include one on-chip programmable voltage comparator. The
Comparator is shown in Figure 7.1.
The Comparator offers programmable response time and hysteresis, an analog input multiplexer, and two
outputs that are optionally available at the Port pins: a synchronous “l(fā)atched” output (CP0), or an asyn-
chronous “raw” output (CP0A). The asynchronous CP0A signal is available even when the system clock is
not active. This allows the Comparator to operate and generate an output with the device in STOP or SUS-
PEND mode. When assigned to a Port pin, the Comparator output may be configured as open drain or
push-pull (see Section “13.2. Port I/O Initialization” on page 126). The Comparator may also be used as a
reset source (see Section “11.5. Comparator Reset” on page 110).
The Comparator inputs are selected in the CPT0MX register (SFR Definition 7.2). The CMX0P3–CMX0P0
bits select the Comparator0 positive input; the CMX0N3–CMX0N0 bits select the Comparator0 negative
input.
Important Note About Comparator Inputs: The Port pins selected as Comparator inputs should be con-
figured as analog inputs in their associated Port configuration register and configured to be skipped by the
Crossbar (for details on Port configuration, see Section “13.3. General Purpose Port I/O” on page 128).
Figure 7.1. Comparator Functional Block Diagram
The Comparator output can be polled in software, used as an interrupt source, internal oscillator suspend
awakening source and/or routed to a Port pin. When routed to a Port pin, the Comparator output is avail-
able asynchronous or synchronous to the system clock; the asynchronous output is available even in
STOP or SUSPEND mode (with no system clock active). When disabled, the Comparator output (if
assigned to a Port I/O pin via the Crossbar) defaults to the logic low state, and its supply current falls to
VDD
CPT0C
N
Reset
Decision
Tree
+
-
Crossbar
Interrupt
Logic
Q
SET
CLR
D
Q
SET
CLR
D
(SYNCHRONIZER)
GND
CP0 +
CP0 -
P0.1
P0.3
P0.5
P0.7*
CP0EN
CP0OUT
CP0RIF
CP0FIF
CP0HYP1
CP0HYP0
CP0HYN1
CP0HYN0
CPT0M
X
CMX0N3
CMX0N2
CMX0N1
CMX0N0
CMX0P3
CMX0P2
CMX0P1
CMX0P0
CPT0MD
CP
0RI
E
CP
0
F
IE
CP
0
M
D
1
CP
0
M
D
0
CP0
CP0A
CP0
Rising-edge
CP0
Falling-edge
CP0
Interrupt
P1.1*
P1.3*
P1.5*
P1.7*
P0.0
P0.2
P0.4
P0.6*
P1.0*
P1.2*
P1.4*
P1.6*
*Available in
'F53x/'F53xA
parts
相關PDF資料 |
PDF描述 |
|---|---|
| VI-B2V-IW | CONVERTER MOD DC/DC 5.8V 100W |
| UPD78F9211CS-CAB-A | MCU 8BIT 2KB FLASH 16PIN |
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| VI-B2R-IX | CONVERTER MOD DC/DC 7.5V 75W |
| VI-B2N-IW | CONVERTER MOD DC/DC 18.5V 100W |
相關代理商/技術參數 |
參數描述 |
|---|---|
| C8051F536A-ITR | 功能描述:8位微控制器 -MCU 25 MIPS 2 kB 256 SPI RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
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| C8051F536-C-IT | 制造商:Silicon Laboratories Inc 功能描述:25 MIPS, 2 KB, 256, SPI, UART, LIN 2.1, TSSOP20 - Rail/Tube 制造商:Silicon Laboratories Inc 功能描述:IC MCU 8051 2KB FLASH 20TSSOP |
| C8051F536-C-ITR | 制造商:Silicon Laboratories Inc 功能描述:25 MIPS, 2 KB, 256, SPI, UART, LIN 2.1, TSSOP20 - Tape and Reel 制造商:Silicon Laboratories Inc 功能描述:IC MCU 8051 2KB FLASH 20TSSOP |
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