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參數(shù)資料
| 型號： | C8051F564-IQ |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 153/302頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 16K FLASH 32-QFP |
| 產(chǎn)品培訓模塊： | Serial Communication Overview |
| 標準包裝： | 250 |
| 系列： | C8051F56x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 50MHz |
| 連通性： | SMBus（2 線/I²C），CAN，LIN，SPI，UART/USART |
| 外圍設備： | POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 25 |
| 程序存儲器容量： | 16KB（16K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.25 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 25x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 32-LQFP |
| 包裝： | 托盤 |
| 配用： | 336-1691-ND - KIT DEVELOPMENT FOR C8051F560 |
| 其它名稱： | 336-1702 |
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C8051F55x/56x/57x
236
Rev. 1.1
23.3. Configuration and Operation
UART0 provides standard asynchronous, full duplex communication. It can operate in a point-to-point
serial communications application, or as a node on a multi-processor serial interface. To operate in a point-
to-point application, where there are only two devices on the serial bus, the MCE0 bit in SMOD0 should be
cleared to 0. For operation as part of a multi-processor communications bus, the MCE0 and XBE0 bits
should both be set to 1. In both types of applications, data is transmitted from the microcontroller on the
TX0 pin, and received on the RX0 pin. The TX0 and RX0 pins are configured using the crossbar and the
Port I/O registers, as detailed in Section “19. Port Input/Output” on page 167.
In typical UART communications, The transmit (TX) output of one device is connected to the receive (RX)
input of the other device, either directly or through a bus transceiver, as shown in Figure 23.5.
Figure 23.5. Typical UART Interconnect Diagram
23.3.1. Data Transmission
Data transmission is double-buffered and begins when software writes a data byte to the SBUF0 register.
Writing to SBUF0 places data in the Transmit Holding Register, and the Transmit Holding Register Empty
flag (THRE0) will be cleared to 0. If the UART’s shift register is empty (i.e., no transmission in progress),
the data will be placed in the Transmit Holding Register until the current transmission is complete. The TI0
Transmit Interrupt Flag (SCON0.1) will be set at the end of any transmission (the beginning of the stop-bit
time). If enabled, an interrupt will occur when TI0 is set.
If the extra bit function is enabled (XBE0 = 1) and the parity function is disabled (PE0 = ‘0’), the value of the
TBX0 (SCON0.3) bit will be sent in the extra bit position. When the parity function is enabled (PE0 = 1),
hardware will generate the parity bit according to the selected parity type (selected with S0PT[1:0]), and
append it to the data field. Note: when parity is enabled, the extra bit function is not available.
23.3.2. Data Reception
Data reception can begin any time after the REN0 Receive Enable bit (SCON0.4) is set to logic 1. After the
stop bit is received, the data byte will be stored in the receive FIFO if the following conditions are met: the
receive FIFO (3 bytes deep) must not be full, and the stop bit(s) must be logic 1. In the event that the
receive FIFO is full, the incoming byte will be lost, and a Receive FIFO Overrun Error will be generated
(OVR0 in register SCON0 will be set to logic 1). If the stop bit(s) were logic 0, the incoming data will not be
stored in the receive FIFO. If the reception conditions are met, the data is stored in the receive FIFO, and
the RI0 flag will be set. Note: when MCE0 = 1, RI0 will only be set if the extra bit was equal to 1. Data can
be read from the receive FIFO by reading the SBUF0 register. The SBUF0 register represents the oldest
byte in the FIFO. After SBUF0 is read, the next byte in the FIFO is immediately loaded into SBUF0, and
space is made available in the FIFO for another incoming byte. If enabled, an interrupt will occur when RI0
is set. RI0 can only be cleared to ‘0’ by software when there is no more information in the FIFO. The rec-
ommended procedure to empty the FIFO contents is as follows:
OR
USB
C8051Fxxx
CP2102
USB-to-UART
Bridge
TX
RX
C8051Fxxx
RX
TX
MCU
RX
TX
PC
USB Port
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