Inputs: Logic 0 = DGND = AGND = 0 V, Logic 1 = VLC, C
參數(shù)資料
型號： CDB5345
廠商： Cirrus Logic Inc
文件頁數(shù)： 13/21頁
文件大?。?/td> 0K
描述： EVALUATION BOARD FOR CS5345
標(biāo)準(zhǔn)包裝： 1
ADC 的數(shù)量： 2
位數(shù)： 24
采樣率（每秒）： 192k
數(shù)據(jù)接口： 串行
在以下條件下的電源（標(biāo)準(zhǔn)）： 400mW @ 5V
工作溫度： -10°C ~ 70°C
已用 IC / 零件： CS5345
已供物品： 板，纜線，CD
相關(guān)產(chǎn)品： CS5345-CQZR-ND - IC ADC AUD 105DB 200KHZ 48-LQFP
598-1691-ND - IC ADC AUD 104DB 200KHZ 48-LQFP
598-1083-ND - IC ADC AUD 104DB 200KHZ 48-LQFP
其它名稱： 598-1780
20
DS658F4
CS5345
SWITCHING CHARACTERISTICS - CONTROL PORT - IC FORMAT
Inputs: Logic 0 = DGND = AGND = 0 V, Logic 1 = VLC, CL =30pF.
19. Data must be held for sufficient time to bridge the transition time, tfc, of SCL.
20. Guaranteed by design.
Parameter
Symbol
Min
Max
Unit
SCL Clock Frequency
fscl
-
100
kHz
RESET Rising Edge to Start
tirs
500
-
ns
Bus Free Time Between Transmissions
tbuf
4.7
-
s
Start Condition Hold Time (prior to first clock pulse)
thdst
4.0
-
s
Clock Low time
tlow
4.7
-
s
Clock High Time
thigh
4.0
-
s
Setup Time for Repeated Start Condition
tsust
4.7
-
s
SDA Hold Time from SCL Falling
thdd
0-
s
SDA Setup time to SCL Rising
tsud
250
-
ns
Rise Time of SCL and SDA
trc, trd
-1
s
Fall Time SCL and SDA
tfc, tfd
-
300
ns
Setup Time for Stop Condition
tsusp
4.7
-
s
Acknowledge Delay from SCL Falling
tack
300
1000
ns
t
buf
t
hdst
t
lo w
t
hdd
t
high
t
sud
Stop
S ta rt
SDA
SC L
t
irs
RS T
t
hdst
t
rc
t
fc
t sust
t susp
Sta rt
Stop
R epe ate d
t
rd
t
fd
t
ack
Figure 5. Control Port Timing - IC Format
相關(guān)PDF資料
PDF描述
ASM06DSEN-S243 CONN EDGECARD 12POS .156 EYELET
ASM06DSEH-S243 CONN EDGECARD 12POS .156 EYELET
MLG1005S82NJ INDUCTOR MULTILAYER 82NH 0402
CDB5341 BOARD EVAL FOR CS5341 STEREO ADC
GCM22DCCS-S189 CONN EDGECARD 44POS R/A .156 SLD
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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