參數(shù)資料
型號： CDB53L21
廠商： Cirrus Logic Inc
文件頁數(shù)： 7/26頁
文件大小： 0K
描述： BOARD EVAL FOR CS53L21 ADC
標(biāo)準(zhǔn)包裝： 1
ADC 的數(shù)量： 2
位數(shù)： 24
采樣率（每秒）： 96k
數(shù)據(jù)接口： 串行
輸入范圍： ±2.5 V
在以下條件下的電源（標(biāo)準(zhǔn)）： 22.45mW @ 48kSPS，2.5 V
工作溫度： -10°C ~ 70°C
已用 IC / 零件： CS53L21
已供物品： 板，CD
產(chǎn)品目錄頁面： 756 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： CS53L21-CNZR-ND - IC ADC STEREO 24BIT 98DB 32-QFN
598-1191-ND - IC ADC STEREO 24BIT 98DB 32QFN
其它名稱： 598-1550
DS700PP1
15
CS53L21
7. After powering up the CS53L21, RESET should be held low after the power supplies and clocks are
settled.
8. See “Example System Clock Frequencies” on page 57 for typical MCLK frequencies.
10. “MCLK” refers to the external master clock applied.
Master Mode (Note 9)
Output Sample Rate (LRCK)
All Speed Modes
Fs
-Hz
LRCK Duty Cycle
45
55
%
SCLK Frequency
1/tP
-
64Fs
Hz
SCLK Duty Cycle
45
55
%
LRCK Edge to SDOUT MSB Output Delay
td(MSB)
-52
ns
SDOUT Setup Time Before SCLK Rising Edge
ts(SDO-SK)
20
-
ns
SDOUT Hold Time After SCLK Rising Edge
th(SK-SDO)
30
-
ns
Parameters
Symbol
Min
Max
Units
MCLK
128
-----------------
th(SK-SDO)
//
MSB
MSB-1
LRCK
SCLK
SDOUT
td(MSB)
ts(LK-SK)
tP
ts(SDO-SK)
Figure 3. Serial Audio Interface Slave Mode Timing
th(SK-SDO)
//
MSB
MSB-1
LRCK
SCLK
SDOUT
td(MSB)
tP
ts(SDO-SK)
Figure 4. Serial Audio Interface Master Mode Timing
相關(guān)PDF資料
PDF描述
MLG1005S36NJ INDUCTOR MULTILAYER 36NH 0402
EBM28DSES-S243 CONN EDGECARD 56POS .156 EYELET
CDB5346 BOARD EVAL FOR CS5346
CDB5345 EVALUATION BOARD FOR CS5345
ASM06DSEN-S243 CONN EDGECARD 12POS .156 EYELET
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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CDB5451A 功能描述:EVAL BOARD CS5451A 6CH ADC RoHS:否 類別:編程器，開發(fā)系統(tǒng) >> 評估板 - 模數(shù)轉(zhuǎn)換器 (ADC) 系列:- 產(chǎn)品培訓(xùn)模塊:Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- ADC 的數(shù)量:1 位數(shù):12 采樣率（每秒）:94.4k 數(shù)據(jù)接口:USB 輸入范圍:±VREF/2 在以下條件下的電源（標(biāo)準(zhǔn)）:- 工作溫度:-40°C ~ 85°C 已用 IC / 零件:MAX11645 已供物品:板，軟件
CDB5460A 制造商:CIRRUS 制造商全稱:Cirrus Logic 功能描述:Evaluation Board and Software
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