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參數(shù)資料
| 型號(hào)： | CS82C5296 |
| 廠商： | Intersil |
| 文件頁數(shù)： | 15/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART/BRG 5V 16MHZ 28-PLCC |
| 標(biāo)準(zhǔn)包裝： | 750 |
| 特點(diǎn)： | 單芯片 UART/BRG |
| 通道數(shù)： | 1，UART |
| 規(guī)程： | RS232C |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 帶并行端口： | 是 |
| 帶故障啟動(dòng)位檢測功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 28-PLCC（11.51x11.51） |
| 包裝： | 帶卷 (TR) |
4
FN2950.3
April 26, 2006
SDI
25
I
High
SERIAL DATA INPUT: Serial data input to the 82C52 receiver circuits. A Mark (1) is high, and a
Space (0) is low. Data inputs on SDI are disabled when operating in the loop mode or when RST is
true.
DR
26
O
High
DATA READY: A true level indicates that a character has been received, transferred to the RBR, and
is ready for transfer to the CPU. DR is reset on a data READ of the Receiver Buffer Register (RBR)
or when RST is true.
VCC
27
High
VCC: +5V positive power supply pin. A 0.1F decoupling capacitor from VCC (Pin 27) to GND (Pin
16) is recommended.
CS0
28
I
Low
CHIP SELECT: The chip select input acts as an enable signal for the RD and WR input signals.
Pin Description (Continued)
SYMBOL
PIN
NO.
TYPE
ACTIVE
LEVEL
DESCRIPTION
82C52
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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