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參數(shù)資料
| 型號： | CY38050V208-125NI |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 10 ns, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁數(shù)： | 21/45頁 |
| 文件大?。?/td> | 720K |
| 代理商： | CY38050V208-125NI |
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Quantum38K ISR
CPLD Family
Document #: 38-03043 Rev. *G
Page 28 of 45
Table 3. Global Signal Bank Assignments
Data sheet Pin Name
Bank Number
GCLK0
0
GCLK1
5
GCLK2
6
GCLK3
7
GCTL0
0
GCTL1
5
GCTL2
6
GCTL3
7
Table 4. 208 EQFP Pin Table
Pin
CY38030
CY38050
CY38100
1
GCTL0
2
GND
3
GCLK0
4
GND
5
IO0
6
IO0
7
IO0
8
IO0
9
IO0
10
IO0
11
VCCIO0
12
IO0
13
IO0
14
IO0
15
IO0
16
IO0
17
IO0
18
IO0
19
IO0
20
VCCIO0
21[12]
IO0
22[12]
IO0
23
VCC
24
GND
25
NC
VCC
26
NC
GND
27[12]
IO0
28
VCCIO0
29
VCCIO1
30[12]
IO1
31[12]
IO1
32[12]
IO1
Note:
12. Capacitance on these I/O pins meets the PCI spec (rev. 2.2), which requires IDSEL pin in a PCI design to have capacitance less than or equal to 8 pF. In the
document titled “Quantum38K CPLD Family data sheet”, this spec is defined as CPCI. All other I/O pins have a capacitance less than or equal to 10 pF.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY38050V256-125BBC | LOADABLE PLD, 10 ns, PBGA256 |
| CY38050V256-125BBI | LOADABLE PLD, 10 ns, PBGA256 |
| CY38050V484-125BBC | LOADABLE PLD, 10 ns, PBGA484 |
| CY38050V484-125BBI | LOADABLE PLD, 10 ns, PBGA484 |
| CY39030Z144-222BBC | LOADABLE PLD, 7 ns, PBGA144 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY38050V208-125NTC | 制造商:Cypress Semiconductor 功能描述:CPLD QUANTUM38K 72K GATES 768 MCRCLLS COMM 0.18UM 2.5V/3.3V - Bulk |
| CY38050V208-125NTI | 制造商:Cypress Semiconductor 功能描述:CPLD QUANTUM38K 72K GATES 768 MCRCLLS IND 0.18UM 2.5V/3.3V 2 - Bulk |
| CY38050V208-83NTC | 制造商:Cypress Semiconductor 功能描述:CPLD QUANTUM38K 72K GATES 768 MCRCLLS COMM 0.18UM 2.5V/3.3V - Bulk |
| CY38050V208-83NTI | 制造商:Cypress Semiconductor 功能描述:CPLD QUANTUM38K 72K GATES 768 MCRCLLS IND 0.18UM 2.5V/3.3V 2 - Bulk |
| CY38100V208-125NTI | 制造商:Cypress Semiconductor 功能描述:CPLD QUANTUM38K 144K GATES 1536 MCRCLLS IND 0.18UM 2.5V/3.3V - Bulk |
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