- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄170345 > CY39030Z144-83BBC (CYPRESS SEMICONDUCTOR CORP) LOADABLE PLD, 15 ns, PBGA144 PDF資料下載
參數(shù)資料
| 型號： | CY39030Z144-83BBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 15 ns, PBGA144 |
| 封裝： | 1 MM PITCH, FBGA-144 |
| 文件頁數(shù)： | 26/57頁 |
| 文件大?。?/td> | 1166K |
| 代理商： | CY39030Z144-83BBC |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁當(dāng)前第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁
PRELIMINARY
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. **
Page 32 of 57
Switching Waveforms (continued)
Cluster Memory Output Register Timing (Asynchronous Inputs)
ADDRESS
tCLMCYC2
tCLMDV2
WRITE
ENABLE
INPUT
GLOBAL CLOCK
(OUTPUT REGISTER)
EGISTERED
OUTPUT
Delta39K-12
Cluster Memory Output Register Timing (Synchronous Inputs)
ADDRESS
tCLMDV2
WRITE
ENABLE
GLOBAL CLOCK
(OUTPUT REGISTER)
REGISTERED
OUTPUT
(INPUT REGISTER)
GLOBAL CLOCK
tCLMCYC2
Delta39K-13
tCLMS
tCLMH
INPUT
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39030Z144-83BBI | LOADABLE PLD, 15 ns, PBGA144 |
| CY39030Z208-222NC | LOADABLE PLD, 7 ns, PQFP208 |
| CY39030Z256-222BBC | LOADABLE PLD, 7 ns, PBGA256 |
| CY39030Z256-222MBC | LOADABLE PLD, 7 ns, PBGA256 |
| CY39050V208-222NTC | LOADABLE PLD, 7 ns, PQFP208 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39030Z208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z208-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z208-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z208-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030Z208-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。