參數(shù)資料
型號(hào)： CY39050Z388-222MGC
廠商： CYPRESS SEMICONDUCTOR CORP
元件分類(lèi)： PLD
英文描述： LOADABLE PLD, 7 ns, PBGA388
封裝： BGA-388
文件頁(yè)數(shù)： 22/57頁(yè)
文件大?。?/td> 1166K
代理商： CY39050Z388-222MGC
PRELIMINARY
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. **
Page 29 of 57
Switching Waveforms (continued)
Clock to Clock
INPUT REGISTER
CLOCK
MACROCELL
REGISTER CLOCK
tSCS
tICS
Delta39K-4
PT Clock to PT Clock
DATA
PT CLOCK
tSCS2PT
tMCSPT
Delta39K-5
INPUT
Asynchronous Reset/Preset
INPUT
tPRO
REGISTERED
OUTPUT
CLOCK
tPRR
tPRW
Delta39K-6
RESET/PRESET
Output Enable/Disable
GLOBAL CONTROL
tER
OUTPUTS
tEA
Delta39K-7
INPUT
相關(guān)PDF資料
PDF描述
CY39050Z484-222MBC LOADABLE PLD, 7 ns, PBGA484
CY39200V208-167NTC LOADABLE PLD, 8.5 ns, PQFP208
CY39200V388-167MGC LOADABLE PLD, 8.5 ns, PBGA388
CY39200V484-167BBC LOADABLE PLD, 8.5 ns, PBGA484
CY39200V676-167MBC LOADABLE PLD, 8.5 ns, PBGA676
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
CY39050Z484-125BBC 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities
CY39050Z484-125BBI 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities
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