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參數(shù)資料
| 型號： | CY8C22213-24PI |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | PSoC Mixed Signal Array |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PDIP20 |
| 封裝： | 0.300 INCH, PLASTIC, DIP-20 |
| 文件頁數(shù)： | 230/304頁 |
| 文件大?。?/td> | 2956K |
| 代理商： | CY8C22213-24PI |
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18. Analog Interface
CY8C22xxx Preliminary Data Sheet
230
Document No. 38-12009 Rev. *D
December 22, 2003
18.2.6
CLK_CR0 Register
An analog column clock generator is provided for each col-
umn. The bits in this register select the source for each col-
umn clock generator. Regardless of the source selected, the
input clock is divided by four to generate the PHI1/PHI2 non-
overlapping clocks for the column. There are four selections
for each clock: VC1, VC2, ACLK0, and ACLK1. VC1 and
VC2 are the programmable global system clocks. ACLK0
and ACLK1 sources are each selected from up to one of
four digital block outputs (functioning as clock generators)
as selected by CLK_CR1.
For additional information, reference the
CLK_CR0 register
on page 154
.
18.2.7
CLK_CR1 Register
Bit 7: Reserved.
Bit 6: SHDIS.
The SHDIS bit in the CLK_CR1 register is
described as follows.
During normal operation of an SC block for the amplifier of a
column enabled to drive the output bus, the connection is
only made for the last half of PHI2 (during PHI1 and for the
first half of PHI2, the output bus floats at the last voltage to
which it was driven). This forms a sample and hold opera-
tion using the output bus and its associated capacitance.
This design prevents the output bus from being perturbed by
the intermediate states of the SC operation (often a reset
state for PHI1 and settling to the valid state during PHI2).
Following are the exceptions: 1) If the ClockPhase bit in
CR0 (for the SC block in question) is set to 1, then the out-
put is enabled for the whole of PHI2. 2) If the SHDIS signal
is set in bit 6 of the Analog Clock Source Control Register,
then sample and hold operation is disabled for all columns
and all enabled outputs of SC blocks are connected to their
respective output busses for the entire period of their
respective PHI2s.
Bits 5 to 0: ACLKx.
There are two 3-bit fields in this regis-
ter that can select up to one of eight digital blocks (depend-
ing on chip resources), to function as the clock source for
ACLK0 and ACLK1. ACLK0 and ACLK1 are alternative
clock inputs to the analog column clock generators (see the
CLK_CR0 register).
For additional information, reference the
CLK_CR1 register
on page 155
.
18.2.8
AMD_CR1 Register
This register controls the selection of the MODBIT for ana-
log column 1. See the AMD_CR0 register. For additional
information, reference the
AMD_CR1 register on page 157
.
18.2.9
ALT_CR0 Register
This register controls the selection of logic functions that
may be selected for the analog comparator bits in column 1.
A one of 16 look-up table (LUT) is applied to the outputs of
each column comparator bit and optionally a neighbor bit to
implement two input logic functions.
Table 18-2
shows the
available functions, where the A input applies to the
selected column, and the B input applies to the next most
significant neighbor column. For CY8C22xxx parts, there is
only one column and B=0.
For additional information, reference the
ALT_CR0 register
on page 158
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY8C22213-24PVI | PSoC Mixed Signal Array |
| CY8C22213-24SI | PSoC Mixed Signal Array |
| CY8C22213-24SIT | PSoC Mixed Signal Array |
| CY8C24794-SPAX | PSoCTM Mixed-Signal Array |
| CY8C24794-SPE | PSoCTM Mixed-Signal Array |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY8C22213-24PVI | 功能描述:IC MCU 2K FLASH 256B 20-SSOP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲器容量:- 程序存儲器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤 |
| CY8C22213-24PVIT | 功能描述:IC MCU 2K FLASH 256B 20-SSOP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲器容量:- 程序存儲器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤 |
| CY8C22213-24SI | 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:PSOC® 3 CY8C38xx 核心處理器:8051 芯體尺寸:8-位 速度:67MHz 連通性:EBI/EMI，I²C，LIN，SPI，UART/USART 外圍設(shè)備:電容感應(yīng)，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):25 程序存儲器容量:64KB（64K x 8） 程序存儲器類型:閃存 EEPROM 大小:2K x 8 RAM 容量:8K x 8 電壓 - 電源 (Vcc/Vdd):1.71 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 2x20b，D/A 4x8b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-VFQFN 裸露焊盤 包裝:托盤 |
| CY8C22213-24SIT | 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標(biāo)準(zhǔn)包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲器容量:- 程序存儲器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤 |
| CY8C22345 | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:PSoC Programmable System-on-Chip |
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