參數(shù)資料
型號： CY8C22213
廠商： Cypress Semiconductor Corp.
英文描述： PSoC Mixed Signal Array
中文描述： PSoC混合信號陣列
文件頁數(shù)： 186/304頁
文件大小： 2956K
代理商： CY8C22213
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁當前第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁
16. Row Digital Interconnect (RDI)
CY8C22xxx Preliminary Data Sheet
186
Document No. 38-12009 Rev. *D
December 22, 2003
16.2
Register Definitions
The only configurable inputs to a Digital PSoC Block Row
are the Global Input Even and Global Input Odd 8-bit bus-
ses. The only configurable outputs from the Digital PSoC
Block Row are the Global Output Even and Global Output
Odd 8-bit busses.
Figure 16-2 on page 185
illustrates the
relationships between global signals and row signals.
Notice on the left side of
Figure 16-2
that global inputs
(GIE[n] and GIO[n]) are inputs to 4-to-1 multiplexers. The
output of these multiplexers are Row Inputs (RI[x]). Because
there are four 4-to-1 multiplexers, each with a unique set of
inputs, a row has access to every global input line in a PSoC
device.
For a complete list of the Digital Row registers showing their
addresses and bit names, reference the
“Digital Register
Summary” on page 176
.
16.2.1
RDIxRI Register
The select bits used to control the four multiplexers are
located in the RDIxRI register, where “x” denotes a place
holder for the row index.
Table 16-2
lists the meaning for
each multiplexer’s four possible settings.
The RDIxRI and RDIxSYN registers are the only two regis-
ters that affect Digital PSoC Row input signals. All other reg-
isters are related to output signal configuration. The options,
with respect to output signals, are discussed below.
For additional information, reference the
RDIxRI register on
page 118
.
16.2.2
RDIxSYN Register
By default, each row input is double synchronized to the
SYSCLK (system clock). However, a user may choose to
disable this synchronization by setting the appropriate RIx-
SYN bit in the RDIxSYN register.
Table 16-3
lists the bit
meanings for each implemented bit of the RDIxSYN register.
The RDIxRI and RDIxSYN registers are the only two regis-
ters that affect Digital PSoC Row input signals. All other reg-
isters are related to output signal configuration. The options,
with respect to output signals, are discussed below.
For additional information, reference the
RDIxSYN register
on page 119
.
16.2.3
RDIxIS Register
As mentioned previously, each LUT has two inputs, where
one of the inputs is configurable (Input A) and the other input
(Input B) is fixed to a row output. The configurable LUT input
(Input A) chooses between a single row output and a single
row input.
Table 16-4
lists the options for each LUT in a row.
The bits are labeled IS, meaning Input Select. The LUT’s
fixed input is always the RO[LUT number + 1], i.e., LUT0’s
fixed input is RO[1], LUT1’s fixed input is RO[2],..., and
LUT3’s fixed input is RO[0].
For additional information, reference the
RDIxIS register on
page 120
.
Table 16-2. RDIxRI Register
RI0[1:0]
0h: GIE[0]
1h: GIE[4]
2h: GIO[0]
3h: GIO[4]
0h: GIE[1]
1h: GIE[5]
2h: GIO[1]
3h: GIO[5]
0h: GIE[2]
1h: GIE[6]
2h: GIO[2]
3h: GIO[6]
0h: GIE[3]
1h: GIE[7]
2h: GIO[3]
3h: GIO[7]
RI1[1:0]
RI2[1:0]
RI3[1:0]
Table 16-3. RDIxSYN Register
RI3SYN
0: Row input 3 in synchronized to 24 MHz system clock
1: Row input 3 is passed without synchronization
0: Row input 2 in synchronized to 24 MHz system clock
1: Row input 2 is passed without synchronization
0: Row input 1 in synchronized to 24 MHz system clock
1: Row input 1 is passed without synchronization
0: Row input 0 in synchronized to 24 MHz system clock
1: Row input 0 is passed without synchronization
RI2SYN
RI1SYN
RI0SYN
Table 16-4. RDIxIS Register Bits
BCSEL[1:0]
0: Row 0 driver local row broadcast net*
1: Row 1 driver local row broadcast net*
2: Row 2 driver local row broadcast net*
3: Row 3 driver local row broadcast net*
0:
The ‘A’ input of LUT 3 is RO[3]
1:
The ‘A’ input of LUT 3 is RI[3]
0:
The ‘A’ input of LUT 2 is RO[2]
1:
The ‘A’ input of LUT 2 is RI[2]
0:
The ‘A’ input of LUT 1 is RO[1]
1:
The ‘A’ input of LUT 1 is RI[1]
0:
The ‘A’ input of LUT 0 is RO[0]
1:
The ‘A’ input of LUT 0 is RI[0]
* When the BCSELL value is equal to the row number, the tri-state buffer
that drives the row broadcast net from the input select mux, is disabled, so
that one of the row’s blocks may drive the local row broadcast net.
* If the row is not present in the part, the selection provides a Logic 1 value.
IS3
IS2
IS1
IS0
相關PDF資料
PDF描述
CY8C22213-24LFI PSoC Mixed Signal Array
CY8C22213-24PI PSoC Mixed Signal Array
CY8C22213-24PVI PSoC Mixed Signal Array
CY8C22213-24SI PSoC Mixed Signal Array
CY8C22213-24SIT PSoC Mixed Signal Array
相關代理商/技術參數(shù)
參數(shù)描述
CY8C22213-24LFI 功能描述:IC MCU 2K FLASH 256B 32VQFN RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標準包裝:250 系列:LPC11Uxx 核心處理器:ARM? Cortex?-M0 芯體尺寸:32-位 速度:50MHz 連通性:I²C，Microwire，SPI，SSI，SSP，UART/USART，USB 外圍設備:欠壓檢測/復位，POR，WDT 輸入/輸出數(shù):40 程序存儲器容量:96KB（96K x 8） 程序存儲器類型:閃存 EEPROM 大小:4K x 8 RAM 容量:10K x 8 電壓 - 電源 (Vcc/Vdd):1.8 V ~ 3.6 V 數(shù)據(jù)轉換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-LQFP 包裝:托盤 其它名稱:568-9587
CY8C22213-24PI 功能描述:IC MCU 2K FLASH 256B 20-DIP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標準包裝:250 系列:LPC11Uxx 核心處理器:ARM? Cortex?-M0 芯體尺寸:32-位 速度:50MHz 連通性:I²C，Microwire，SPI，SSI，SSP，UART/USART，USB 外圍設備:欠壓檢測/復位，POR，WDT 輸入/輸出數(shù):40 程序存儲器容量:96KB（96K x 8） 程序存儲器類型:閃存 EEPROM 大小:4K x 8 RAM 容量:10K x 8 電壓 - 電源 (Vcc/Vdd):1.8 V ~ 3.6 V 數(shù)據(jù)轉換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-LQFP 包裝:托盤 其它名稱:568-9587
CY8C22213-24PVI 功能描述:IC MCU 2K FLASH 256B 20-SSOP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標準包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設備:欠壓檢測/復位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲器容量:- 程序存儲器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤
CY8C22213-24PVIT 功能描述:IC MCU 2K FLASH 256B 20-SSOP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標準包裝:60 系列:BlueStreak ; LH7 核心處理器:ARM7 芯體尺寸:32-位 速度:84MHz 連通性:EBI/EMI，SPI，SSI，SSP，UART/USART 外圍設備:欠壓檢測/復位，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):76 程序存儲器容量:- 程序存儲器類型:ROMless EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.7 V ~ 3.6 V 數(shù)據(jù)轉換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:144-LQFP 包裝:托盤
CY8C22213-24SI 功能描述:IC MCU 2K FLASH 256B 20-SOIC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:PSOC®1 CY8C22xxx 標準包裝:60 系列:PSOC® 3 CY8C38xx 核心處理器:8051 芯體尺寸:8-位 速度:67MHz 連通性:EBI/EMI，I²C，LIN，SPI，UART/USART 外圍設備:電容感應，DMA，LCD，POR，PWM，WDT 輸入/輸出數(shù):25 程序存儲器容量:64KB（64K x 8） 程序存儲器類型:閃存 EEPROM 大小:2K x 8 RAM 容量:8K x 8 電壓 - 電源 (Vcc/Vdd):1.71 V ~ 5.5 V 數(shù)據(jù)轉換器:A/D 2x20b，D/A 4x8b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-VFQFN 裸露焊盤 包裝:托盤
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