VOUT DATA LOADED MSB(D11) FIRST DAC REGISTER LOAD D11 D" />
參數(shù)資料
型號: DAC8043AFRU
廠商: Analog Devices Inc
文件頁數(shù): 4/8頁
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描述: IC DAC 12BIT MULT SRL INP 8TSSOP
產品培訓模塊: Data Converter Fundamentals
DAC Architectures
標準包裝: 96
設置時間: 250ns
位數(shù): 12
數(shù)據(jù)接口: 串行
轉換器數(shù)目: 1
電壓電源: 單電源
功率耗散(最大): 500µW
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 8-TSSOP(0.173",4.40mm 寬)
供應商設備封裝: 8-TSSOP
包裝: 管件
輸出數(shù)目和類型: 1 電流,單極;1 電流,雙極
采樣率(每秒): 4M
REV. B
DAC8043A
–4–
SRI
CLK
LD
SRI
CLK
LD
FS
ZS
VOUT
DATA LOADED MSB(D11) FIRST
DAC REGISTER LOAD
D11
D10
D9
D8
D6
D5
D4
D3
D2
D1
D0
D7
tLD1
tDS
tDH
tCL
tCH
tLD
tS
1 LSB
ERROR BAND
Dxx
tASB
Figure 2. Timing Diagram
Table I. Control-Logic Truth Table
CLK
LD
Serial Shift Register Function
DAC Register Function
u
H
Shift-Register-Data Advanced One Bit Latched
H or L
L
No Effect
Updated with Current Shift Register Contents
L
u
No Effect
Latched All 12 Bits
NOTES
u positive logic transition.
The DAC Register
LD input is level-sensitive. Any time LD is logic-low data in the serial register will directly control the
switches in the R-2R DAC ladder.
TOTAL UNADJUSTED ERROR – LSB
FREQUENCY
15
20
0
–1.0
1.0
10
30
–0.5
0.0
0.5
SS = 200 UNITS
TA = 25 C
VDD = 5V
VREF = 10V
25
5
35
Figure 3. Total Unadjusted Error Histogram
Typical Performance Characteristics
FULL SCALE TEMPCO – ppm/ C
FREQUENCY
30
20
0
10
40
50
SS = 200 UNITS
TA = –40 C TO +85 C
VDD = 5V
VREF = 10V
12
Figure 4. Full-Scale Output Tempco Histogram
相關PDF資料
PDF描述
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參數(shù)描述
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DAC8043AFRUZ 功能描述:IC DAC 12BIT MULT SRL INP 8TSSOP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉換器 系列:- 標準包裝:1 系列:- 設置時間:4.5µs 位數(shù):12 數(shù)據(jù)接口:串行,SPI? 轉換器數(shù)目:1 電壓電源:單電源 功率耗散(最大):- 工作溫度:-40°C ~ 125°C 安裝類型:表面貼裝 封裝/外殼:8-SOIC(0.154",3.90mm 寬) 供應商設備封裝:8-SOICN 包裝:剪切帶 (CT) 輸出數(shù)目和類型:1 電壓,單極;1 電壓,雙極 采樣率(每秒):* 其它名稱:MCP4921T-E/SNCTMCP4921T-E/SNRCTMCP4921T-E/SNRCT-ND
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