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參數(shù)資料
| 型號： | DJIXEECD0SE001 |
| 廠商： | Intel Corp. |
| 英文描述： | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| 中文描述： | 先進(jìn)的8端口10/100 Mbps的物理層收發(fā)器 |
| 文件頁數(shù)： | 86/226頁 |
| 文件大小： | 1575K |
| 代理商： | DJIXEECD0SE001 |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
88
Datasheet
Document Number: 249241
Revision Number: 007
Revision Date: August 28, 2003
Table 29. Intel
LXT9785/LXT9785E Signal Detect – BGA23
Ball/Pin
Designation
Symbol
Type
1
Signal Description
2,3
BGA23
PQFP
P1
95
SD_2P5V
I, ST, ID
Signal Detect 2.5 Volt Interface.
SD input threshold voltage select.
Tie to VCCPECL =
Select 2.5 V LVPECL input levels
Float or Tie to GNDPECL
=
Select 3.3 V LVPECL input
levels
P2,
N4,
P3,
N5,
P15,
P16,
P17,
N17
96
97
100
101
161
162
165
166
SD0
SD1
SD2
SD3
SD4
SD5
SD6
SD7
I
Signal Detect - Ports 0-7.
Signal Detect input from the fiber transceiver (these inputs
are only active for ports operating in fiber mode).
Logic High =
Normal operation (the process of searching
for receive idles for the purpose of bringing link up is
initiated)
Logic Low =
Link is declared lost
1. Type Column Coding: I = Input, O = Output, OD = Open Drain output, ST = Schmitt Triggered input, TS =
Three-State-able output, SL = Slew-rate Limited output, IP = weak Internal Pull-up, ID = weak Internal pull-
Down.
2. The IP/ID resistors are disabled during H/W Power-Down mode.
3. Tie SD[0:7] inputs to GNDPECL if unused.
Table 30. Intel
LXT9785/LXT9785E Network Interface Signal Descriptions – BGA23
Ball/Pin Designation
Symbol
Type
1
Signal Description
BGA23
PQFP
T2, U1,
T3, R4,
T6, U5,
U7, T7,
T10, R10,
T11, U11,
T14,U15,
R14, T15
107, 108
111, 110
121, 122
125, 124
136, 137
140, 139
150, 151
154, 153
TPFOP0, TPFON0
TPFOP1, TPFON1
TPFOP2, TPFON2
TPFOP3, TPFON3
TPFOP4, TPFON4
TPFOP5, TPFON5
TPFOP6, TPFON6
TPFOP7, TPFON7
AO/AI
Twisted-Pair/Fiber Outputs
2
, Positive &
Negative, Ports 0-7.
During 100BASE-TX or 10BASE-T operation,
TPFO pins drive 802.3 compliant pulses onto
the line.
During 100BASE-FX operation, TPFO pins
produce differential LVPECL outputs for fiber
transceivers.
R2, T1,
U3, T4,
R6, T5,
T8, R8,
T9, U9,
U13, T12,
R12, T13,
R16, T16
104, 105
115, 114
118, 119
129, 128
132, 133
143, 142
146, 147
157, 156
TPFIP0, TPFIN0
TPFIP1, TPFIN1
TPFIP2, TPFIN2
TPFIP3, TPFIN3
TPFIP4, TPFIN4
TPFIP5, TPFIN5
TPFIP6, TPFIN6
TPFIP7, TPFIN7
AI/AO
Twisted-Pair/Fiber Inputs
3
, Positive &
Negative, Ports 0-7.
During 100BASE-TX or 10BASE-T operation,
TPFI pins receive differential 100BASE-TX or
10BASE-T signals from the line.
During 100BASE-FX operation, TPFI pins
receive differential LVPECL inputs from fiber
transceivers.
1. Type Column Coding: AI = Analog Input, AO = Analog Output.
2. Switched to Inputs (see TPFIP/N description) when not in fiber mode and MDIX is not active [that is,
twisted-pair, non-crossover MDI mode].
3. Switched to Outputs (see TPFOP/N description) when not in fiber mode and MDIX is not active [that is,
twisted-pair, non-crossover MDI mode].
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DJIXEEED0QE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXEEED0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXEEED0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXEEED0SE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXELAD0QE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DJIXEEED0QE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXEEED0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXEEED0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXEEED0SE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXELAD0QE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
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