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參數(shù)資料
| 型號： | DJIXFPCD0QE000 |
| 廠商： | Intel Corp. |
| 英文描述： | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| 中文描述： | 先進(jìn)的8端口10/100 Mbps的物理層收發(fā)器 |
| 文件頁數(shù)： | 157/226頁 |
| 文件大?。?/td> | 1575K |
| 代理商： | DJIXFPCD0QE000 |
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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
Datasheet
Document Number: 249241
Revision Number: 007
Revision Date: August 28, 2003
159
The LXT9785/LXT9785E includes an IEEE 1149.1 boundary scan test port for board level testing.
All digital input, output, and input/output pins are accessible.
4.12.4
Boundary Scan Interface
This interface consists of five pins (TMS, TDI, TDO, TCK and TRST). It includes a state machine,
data register array, and instruction register. The TMS and TDI pins are internally pulled up and the
TCK pin is internally pulled down. TDO does not have an internal pull-up or pull-down.
4.12.5
State Machine
The TAP controller is a 16-state machine driven by the TCK and TMS pins. Upon reset, the
TEST_LOGIC_RESET state is entered. The state machine is also reset when TMS and TDI are
High for five TCK periods.
4.12.6
Instruction Register
The IDCODE instruction is always invoked after the state machine resets. The decode logic
ensures the correct data flow to the Data registers according to the current instruction. Valid
instructions are listed in
Table 49
.
4.12.7
Boundary Scan Register
Each Boundary Scan Register (BSR) cell has two stages. A flip-flop and a latch are used for the
serial shift stage and the parallel output stage. There are four modes of operation as listed in
Table 48
. Refer to the Identification Information section in the LXT9785/LXT9785E Specification
Update (document number 249357) for the JTAG ID numbers.
Table 48. BSR Mode of Operation
Mode
Description
1
Capture
2
Shift
3
Update
4
System Function
Table 49. Supported JTAG Instructions
Name
Code
Description
Data
Register
EXTEST
0000 Hex
External Test
BSR
IDCODE
FFFE Hex
ID Code Inspection
ID REG
SAMPLE
FFF8 Hex
Sample Boundary
BSR
High Z
FFCF Hex
Force Float
Bypass
Clamp
FFEF Hex
Clamp
BSR
BYPASS
FFFF Hex
Bypass Scan
Bypass
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DJIXFPCD0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFPCD0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFPCD0SE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFPED0QE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFPED0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DJIXFPCD0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFPCD0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
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| DJIXFPED0QE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFPED0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
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