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參數(shù)資料
| 型號(hào)： | DJIXP972MLAA4 |
| 廠商： | Intel Corp. |
| 英文描述： | Single-Port 10/100 Mbps PHY Transceiver |
| 中文描述： | 單端口10/100 Mbps的物理層收發(fā)器 |
| 文件頁(yè)數(shù)： | 11/92頁(yè) |
| 文件大小： | 666K |
| 代理商： | DJIXP972MLAA4 |
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Intel
LXT972M Single-Port 10/100 Mbps PHY Transceiver
Datasheet
Document Number: 302875-005
Revision Date: 27-Oct-2005
11
2.0
Block Diagram for Intel
LXT972M Transceiver
Figure 1
is a block diagram of the LXT972M Transceiver. (This block diagram is the same as the
block diagram on the first page of this document. This copy of the block diagram appears here as a
convenience to the reader.)
Figure 1. Intel
LXT972M Transceiver Block Diagram
TX_EN
RX_ER
CRS
Power Supply
Management /
Mode Select
Logic
ADDR[1:0]
MDIO
MDC
RX_DV
TPON
TPOP
TPIN
TPIP
REFCLK/XI
XO
VCC
GND
COL
RX_CLK
TX_CLK
TXD[3:0]
Decoder &
Descrambler
+
-
Serial-to-
Parallel
Converter
Scrambler
& Encoder
Parallel/Serial
Converter
Carrier Sense
Data Valid
Error Detect
Auto
Negotiation
Manchester
Decoder
Manchester
Encoder
10
100
10
100
Media
Select
TP
Driver
TP Out
Register
Set
Register Set
Clock
Generator
+
-
10BT
Collision
Detect
Clock
Generator
OSP
Adaptive EQ with
Baseline Wander
Cancellation
OSP
Slicer
OSP
Pulse
Shaper
RXD[3:0]
+
-
100TX
TP In
R
JTAG
5
TDO
TMS
TCK
TRST_L
RESET_L
B3387-13
LED/CFG[3:1]
TDI
T
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