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參數(shù)資料
| 型號： | DJIXPECD0QE000 |
| 廠商： | Intel Corp. |
| 英文描述： | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| 中文描述： | 先進(jìn)的8端口10/100 Mbps的物理層收發(fā)器 |
| 文件頁數(shù)： | 11/226頁 |
| 文件大?。?/td> | 1575K |
| 代理商： | DJIXPECD0QE000 |
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Datasheet
Document Number: 249241
Revision Number: 007
Revision Date: August 28, 2003
11
Contents
120
Modified/added text under
Section 4.3.2, “Internal Loopback”
.
121
Modified text under
Section 4.3.6, “MII Isolate”
.
121
Section 4.3.7, “MDIO Management Interface”
:
Added note under second paragraph.
Added last paragraph.
123
Added note under
Section 4.3.8, “MII Sectionalization”
.
124
Added new
Section 4.3.11, “FIFO Initial Fill Values”
125
Modified paragraph three under
Section 4.4.1, “Power Requirements”
.
127
Added notes under second and last paragraphs under
Section 4.5.3, “Power-Down Mode”
.
128
Modified last bullet under
Section 4.5.3.1, “Global (Hardware) Power Down”
.
128
Added last paragraph to
Section 4.5.4, “Reset”
.
129
Modified
Table 42 “Intel LXT9785/9785E Global Hardware Configuration Settings”
.
130
Change heading and modified last line under
Section 4.6.1.2, “Manual Next Page Exchange”
.
130
Section 4.6.1.4, “Link Criteria”
:
Changed scrambler to descrambler in first line.
Modified second paragraph.
Added two new paragraphs.
131
Added second paragraph under
Section 4.6.1.5, “Parallel Detection”
.
131
Modified paragraphs under
Section 4.6.1.6, “Reliable Link Establishment While Auto MDI/MDIX is
Enabled in Forced Speed Mode”
.
136
Changed “1110” to “0101” under
Section 4.7.4.3, “Receive Error”
.
141
Added note under first paragraph of
Section 4.8, “RMII Operation”
148
Changed “asynchronously” to “synchronously” in second paragraph under
Section 4.9.3.3, “Carrier
Sense/Data Valid (RMII)”
.
148
Modified last sentence in first paragraph under
Section 4.9.3.4, “Carrier Sense (SMII)”
.
149
Modified paragraph under
Section 4.9.3.6.3, “Polarity Correction”
.
149
Added note under
Section 4.9.3.7, “Fiber PMD Sublayer”
.
149
Added second paragraph under
Section 4.9.3.7.1, “Far End Fault Indications”
.
150
Modified/added text under
Section 4.10.1, “Preamble Handling”
.
151
Modified text under
Section 4.10.4, “Jabber”
.
152
Modified first paragraph under
Section 4.11, “DTE Discovery Process”
.
153
Modified Item 1 of
Section 4.11.2, “Interaction between Processor, MAC, and PHY”
.
154
Modified second paragraph under
Section 4.11.4, “DTE Discovery Process Flow”
.
155
Added
Section 4.11.5, “DTE Discovery Behavior”
157
Added BGA15 information into first paragraph under
Section 4.12.2, “Per-Port LED Driver
Functions”
.
158
Added last sentence to first paragraph and note under first paragraph under
Section 4.12.3, “Out-of-
Band Signaling”
.
160
Added
Section 4.13, “Cable Diagnostics Overview”
.
161
Modified/added text under
Section 4.13.3, “Implementation Considerations”
.
Revision Number: 007
Revision Date: August 28, 2003
Page
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DJIXPECD0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPECD0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPECD0SE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJLXTPCD0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJLXTPCD0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DJIXPECD0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPECD0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPECD0SE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPEED0QE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXPEED0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
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